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  1. alu_all

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  2. 用VHDL实现ALU的编码,运行环境Quartus27.2-ALU using VHDL coding to achieve, Quartus27.2 operating environment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.49mb
    • 提供者:lintong
  1. edaczcjfq

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  2. 出租车计费,器设计一个出租车自动计费器,计费包括起步价、行车里程计费、停止和暂停不计费三部分。现场模拟汽车的启动、停止、暂停和换挡状态。分别用四位数码管显示金额和里程,各有两位小数,行程 3公里内,起步费为6元,超过3公里,以每公里1.3元计费(Car repair billing device)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-05-07
    • 文件大小:1.49mb
    • 提供者:jdjddjdj
  1. fpga

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  2. 文章概括介绍了FPGA在医学成像系统中的应用。-introduce the appliance of FPGA in the medical imaging system.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.49mb
    • 提供者:guoguo
  1. SOPC_exp

    0下载:
  2. spoc实验的详细步骤,构建sopc系统,快速入门-the detail to do experiments by sopc
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.49mb
    • 提供者:常伟
  1. LCD1602_12864

    0下载:
  2. LCD显示的verilog语言编程,提供静态及动态显示过程-LCD display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.49mb
    • 提供者:xuyingying
  1. dianziqin

    0下载:
  2. 实现电子琴电子设计自动化的功能,利用数控分频器设计硬件电子琴,当按下琴键时,扬声器发出该琴键相对应的音阶,同时数码管显示音阶数字,若为高音时,二极管点亮。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.49mb
    • 提供者:lianmao
  1. ise8tut

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  2. 定时器的VHDL程序,包括几个文件,分别使用了集中顶事方式.-timer program using vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.49mb
    • 提供者:秦皓添
  1. XilinxISE8

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  2. This tutorial gives a descr iption of the features and additions to Xilinx® ISE™ 8.2i. The primary focus of this tutorial is to show the relationship among the design entry tools, Xilinx and third-party tools, and the design implementatio
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.49mb
    • 提供者:JERRY
  1. A3P40_ProASIC3

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  2. ProASIC3, the third-generation family of Actel flash FPGAs, offers performance, density, and features beyond those of the ProASICPLUS® family. Nonvolatile flash technology gives ProASIC3 devices the advantage of being a secure, low-power, sing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-19
    • 文件大小:1.49mb
    • 提供者:laolixue
  1. sopc_cpu

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  2. 此例程是基于FPGA的SOPC工程实例,是对CPU操作运用的一个很不错的程序,内有modelsim仿真激励,都是测试过的好程序-This routine is FPGA-based SOPC engineering practice, the use of CPU operation is a very good program, there modelsim simulation stimulus, good procedures are tested
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.49mb
    • 提供者:liujian
  1. learning_cpld_in_5_minutes

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  2. 5分钟学会CPLD 是cpld/fpga入门的好材料-5 minutes Society CPLD are cpld/fpga good entry-Materials
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.49mb
    • 提供者:李晓东
  1. ym38

    0下载:
  2. 3输入8输出译码器,可以达到对3位二进制数码进行译码的效果,并且可以在数码管上显示-3 input 8 output decoder can achieve the effect of three binary digital decoding, and can be displayed on the digital tube
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.49mb
    • 提供者:姚欢
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