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  1. Sequence-Detector

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  2. 利用状态机设计一个序列检测器,用以检测“1101”。用btn[1]和btn[0]作为输入分别代表1和0,输入的当前数字显示在数码管最后一位,每当新输入一个数字,之前输入的数字左移一位,依次显示出最近输入的四位数字,无输入时数码管不显示任何数字。clk时钟需要分频后才可作为检测时钟(建议分频至190Hz),每当检测到序列中有“1101”出现时,led[0]点亮,即数码显示管上显示“1101”时led[0]点亮;当按下btn[2]时恢复初始状态。-The use of a state machine
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.4kb
    • 提供者:刘东辉
  1. EDA

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  2. 用EDA实现串行输入并行输出的移位寄存器,附带仿真-Serial Input with EDA parallel output shift register, with simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:4.4kb
    • 提供者:文心
  1. micro-processor

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  2. 这是一个8位微处理器的vhdl设计代码。-This is the design of a 8-bit micro-processor.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-09
    • 文件大小:4.4kb
    • 提供者:baoshu
  1. ads8361_avl

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  2. Interface for ADS8361 TI ADC IP Core for ALTERA NIOS2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-08
    • 文件大小:4.4kb
    • 提供者:Igor
  1. jtd

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  2. 交通灯课程设计, 红黄绿自动切换三种灯 verilog语言实现-failed to translate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.4kb
    • 提供者:曹虫
  1. uart.ZIP

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  2. a general UART port. Tested.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.4kb
    • 提供者:sean
  1. N-0.5fenpinqi

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  2. vhdl N-0.5分频方法设计,可以输入任意数值N,即分得到N-0.5的频率。-vhdl N - 0.5-frequency method, we can input arbitrary numerical N, namely, to be N - 0.5 frequencies.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:4.4kb
    • 提供者:孔标
  1. key

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  2. 键盘应用程序,通过键盘控制数码管显示相应的数值-Keyboard application programme
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:4.4kb
    • 提供者:龙淮祁
  1. cyc

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  2. VHDL source codes for ALU modules.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:4.41kb
    • 提供者:John
  1. lcd2

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  2. lcd display vhdl windows
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.41kb
    • 提供者:nick
  1. mdi_o

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  2. 这个是mdio的源码程序,可以拿来直接用-this is mdio program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4.41kb
    • 提供者:王风
  1. 8.3LCD

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  2. FPGA中使用VHDL语言编写的LCD控制程序-FPGA using VHDL language of the LCD control procedures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:4.41kb
    • 提供者:felix chin
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