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  1. steppercontrol

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  2. 一个步进电机控制器的程序,包含了两个电机的控制,一路编码器的接收,串口的接收,脉冲的输出,非常综合-Stepper motor controller program contains two motor control, all the way to the reception of the encoder, serial receiver, pulse output, very comprehensive
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-06
    • 文件大小:14.9mb
    • 提供者:bingo
  1. EMAC6

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  2. verilog实现的FPGA三态以太网链路层通信代码,里面有状态机,并按各个模块的功能分了文件夹,还有说明文档,自定义帧的产生和接收,开发环境为Xilinx ISE,测试无误。-verilog realization FPGA Tri-Mode Ethernet link layer communication code, which the state machine, according to the function of each module sub folder, as well a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-12-20
    • 文件大小:3.44mb
    • 提供者:trygov
  1. DS18B20_NEW2

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  2. DS18B20 FPGA 数字温度计-DS18B20 FPGA digital temperature
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-22
    • 文件大小:1.29mb
    • 提供者:zhangruimin
  1. assignment-1-(2)

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  2. verilog coding of basic concept
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-06
    • 文件大小:117.83kb
    • 提供者:Nisha
  1. ENDAT

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  2. 一个用于接收ENDATA2.1协议的接口程序,经过测试该程序运行正确-One for receiving ENDAT 2.1 protocol interface program, tested the program runs correctly
  3. 所属分类:VHDL编程

    • 发布日期:2013-09-06
    • 文件大小:1.58kb
    • 提供者:bingo
  1. triple_sdi_rx

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  2. XILINX VIRTEX5 triple_SDI接受端-XILINX VIRTEX5 triple_SDI receiving end
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-07
    • 文件大小:12.06kb
    • 提供者:wujunlin
  1. simple-divider

    0下载:
  2. simple divider vhdl code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:575byte
    • 提供者:kavi
  1. division-by-convergence

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  2. a code for goldschmidt divider-a code for goldschmidt divider....
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-04
    • 文件大小:1.24kb
    • 提供者:kavi
  1. THE-FIR-Base-on-FPGA

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  2. 基于fpga的FIR滤波器实现,程序为11阶滤波器实现的源代码-Fpga-based FIR filter implementation, the source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-12
    • 文件大小:3.03kb
    • 提供者:周亮
  1. RSA

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  2. programme qui decrit l algorithme de chiffremment RSA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-22
    • 文件大小:507.51kb
    • 提供者:deka
  1. test_goldschmidt.vhd

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  2. code to test a goldschmidt divider-code to test a goldschmidt divider
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-06
    • 文件大小:1.2kb
    • 提供者:kavi
  1. Verilog_divid

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  2. vhdl语言描述传统除法器,传统乘法器的改进,从原理到实现的传统除法器-vhdl language to describe the traditional divider, the improvement of traditional multiplier principle to achieve the traditional divider
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-02
    • 文件大小:1.05mb
    • 提供者:黄玲
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