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  1. ppt

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  2. Verilog课件,包括概论。语法。-verilog ppt include introduction,semantics and so on
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.86mb
    • 提供者:liwei
  1. flushpcnisee

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  2. soil structure interaction analysis program from NIS-soil structure interaction analysis program from NISEE
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:108.74kb
    • 提供者:codici
  1. lift

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  2. 用VHDL编写的全功能四层电梯控制器-Prepared with a fully functional VHDL four elevator controller. . .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:16.99kb
    • 提供者:aiyun
  1. wm8731App1

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  2. 刚完成的基于DE2-70FPGA开发板的音频处理程序,研究了3天,好不容易完成的。使用WM8731芯片实现AD采集,然后通过DA输出到line out.-Recently completed development board based on DE2-70FPGA audio processing procedures of the three days, finally completed. AD using the WM8731 chip collection, and then DA o
  3. 所属分类:VHDL编程

    • 发布日期:2014-02-23
    • 文件大小:2.54mb
    • 提供者:ne
  1. plpp_answers

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  2. Programming Languages - Principles and Practice 2nd Edition by Kenneth C. Louden Thomson Brooks/Cole 2002 Answers to Selected Exercises
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:364.93kb
    • 提供者:belen
  1. kangxingongsi

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  2. 康芯公司的培训内容,内含很多FPGA的使用事项和经验教习,希望多大家有所帮助。-The core of company training contents of Cornwall, containing many FPGA use and experience, hope everybody toupees and help.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:7.2kb
    • 提供者:法阿
  1. 2FSK_decode

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  2. 程序实现2FSK的解调,使用过零检测法,分为预处理模块和鉴频处理模块,Verilog语言,在modelsim仿真通过-2FSK Program for demodulation of zero-crossing detection method used, divided into pre-processing module and the discriminator processing module, Verilog language, adopted in the modelsim sim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:17.3kb
    • 提供者:卢平
  1. shigfr

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  2. 循环移位,实现cpld控制dac的数据采集,分时传输来那个词数据-Cyclic shift, to achieve control dac cpld data collection, sharing of data transmission to the word
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:582byte
    • 提供者:shujun
  1. VGA_char_ROM_success

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  2. Verilog HDL语言编写的基于M4K块配置ROM的字符数据存储VGA显示实验代码,引脚分配适用于21EDA的EP2C8Q208开发板, 详细解说请参见特权同学《深入浅出玩转FPGA》视频教程中的《Lesson30:SF-EP1C开发板实验9——基于M4K块配置ROM的字符数据存储VGA显示实验》-experimental code written in Verilog HDL language,ROM configuration based on M4K block for the cha
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:766.5kb
    • 提供者:LM
  1. fifo_vhdl

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  2. FIFO using vhdl and aslo configurable
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:6.51kb
    • 提供者:narayan
  1. FPGASERIALPORT

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  2. 利用VHDL语言实现串口通信,本程序经过调试可以正常使用。-VHDL SERIAL PORT COMMUNICATION
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3.84kb
    • 提供者:刘茜
  1. fsq

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  2. 利用VHDL语言实现信号发生器。 -VHDL SIGNAL GENERATE
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:445.63kb
    • 提供者:刘茜
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