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  1. i2c_master

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  2. I2C控制器,应用于各种I2C主从设备间的通讯-I2C controller, applied to a variety of I2C communication between master and slave devices
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:4.98kb
    • 提供者:朱红梅
  1. yunlei

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  2. 实现出租车计费系统,包含所有的源文件-Taxi billing system to achieve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:732.03kb
    • 提供者:lilei
  1. data_pro

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  2. 用于SD卡通信控制部分的数据收发部分,verilog语言描述-SD cards for some of the data send and receive communication control part, verilog language to describe the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:8.78kb
    • 提供者:朱红梅
  1. SYNC_FIFO

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:870byte
    • 提供者:gasha
  1. Clock_Edge

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:614byte
    • 提供者:gasha
  1. Avalon_Audio

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.85kb
    • 提供者:gasha
  1. cmd_pro

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  2. 用于SD卡通信控制部分的命令收发部分,verilog语言描述-Communications control part for the SD card send and receive part of the command, verilog language to describe the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:7.44kb
    • 提供者:朱红梅
  1. Audio_Out_Serializer

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:1.19kb
    • 提供者:gasha
  1. Audio_In_Deserializer

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:1.21kb
    • 提供者:gasha
  1. Audio_Bit_Counter

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  2. The Audio Core interacts with the Audio CODEC (enCOder/DECoder) on the Altera DE2/DE1 Boards and provides an interface for audio input and outpu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:782byte
    • 提供者:gasha
  1. vhdltest

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  2. 自己设计的几个VHDL程序,包括译码器电路,多路开关,比较器应用,和16乘8RAM电路,各模块及最终的顶层原理图和引脚我都已给好,希望对大家的学习有所帮助-A few of their own design VHDL procedures, including the decoder circuit, multiple switches, comparator applications, and 16 by 8RAM circuit, each module and final top-leve
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:888.87kb
    • 提供者:李晓
  1. verilog_code

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  2. 《Verilog HDL程序设计教程》程序源码(王金明)-" Verilog HDL Programming Tutorial" program source code (Wang Jinming)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:169.02kb
    • 提供者:luxucheng
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