文件名称:mul1617
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- 上传时间：2012-11-16
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采用verilog RTL级语言，实现了有符号的16位乘17位的乘法器。特点是：采用流水的结构，可以在一个周期内处理完数据。通过QuartusII和Modulesim的功能仿真和时序仿真，并得到正确结果。-Realize the signs of 16 of the 17 patients take on time-multiplier. Features are: the structure of water, can be in a cycle processes the data. Through the QuartusII and Modulesim function simulation and timing simulation, and get the right result.
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mul1617.v
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