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文件名称:CNN

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2020-06-17
  • 文件大小：
    1.72mb
  • 已下载：
    1次
  • 提 供 者：
    goth****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

THU微纳电子系ic设计课程大作业，使用verilog实现CNN加速器，含一层卷积和池化，仿真通过。(a CNN accelerator written in VerilogHDL, including one conv layer and one pooling layer, simulation passed)
相关搜索： 数字电路 CNN加速器

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CNN 0 2019-12-17
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CNN\cnn_post.v 43957 2019-12-03
CNN\cnn设计报告.docx 1983259 2019-12-11
CNN\convolution.v 321 2019-12-11
CNN\ctrl.v 1466 2019-11-29
CNN\Data_reg.v 151 2019-11-29
CNN\image.txt 638 2019-11-29
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CNN\simple_conv_pool.v 1180 2019-11-29
CNN\simple_conv_pool_P.v 47297 2019-12-03
CNN\tb.v 462 2019-12-11
CNN\tb_p.v 521 2019-12-03

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