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文件名称:18a

  • 所属分类：
    Embeded-SCM Develop
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-10-13
  • 文件大小：
    50.21kb
  • 已下载：
    0次
  • 提 供 者：
    洪***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
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如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

匹配滤波器设计，VERILOG实现的，比较好的哦-Matched filter design, VERILOG implementation, and better oh
相关搜索： Verilog matched filter Verilog Filter verilog 匹配滤波器 滤波器 FPGA vhdl matched filter 匹配滤波器

(系统自动生成,下载前可以参看下载内容)

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ht.v
LIB.DLS
U9654108.DLS
ht.cnf
ht.scf
ht(1).cnf
ht(2).cnf
ht(3).cnf
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