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  1. tcm_code

    1下载:
  2. tcm 编码 代码是V_LOG从工程中直接烤的 可以直接编译使用-tcm code V_LOG CODE
  3. 所属分类:Communication

    • 发布日期:2017-03-29
    • 文件大小:622
    • 提供者:刘伟
  1. barker

    0下载:
  2. 帧同步的实现方法,基于7位巴克码的实现,采用V_LOG编写成的工程例子 可以直接编译-Frame Synchronization Method, 7 based on the realization of Barker Code, adopted the project into V_LOG example of the preparation can be directly compiled
  3. 所属分类:Communication

    • 发布日期:2017-03-28
    • 文件大小:842
    • 提供者:刘伟
  1. unit4

    0下载:
  2. Part 3 - Verilog Documents-Part 3- Verilog Documents
  3. 所属分类:Document

    • 发布日期:2017-05-01
    • 文件大小:645573
    • 提供者:haihoisua
  1. labs

    0下载:
  2. Xilinx embeded system labs
  3. 所属分类:software engineering

    • 发布日期:2017-03-29
    • 文件大小:771902
    • 提供者:hieu dang van
  1. year

    0下载:
  2. 工程备份综合教程,主讲的数学用法,建议大家下载-Integrated Course backup works, the use of mathematical topics, it is recommended you download
  3. 所属分类:software engineering

    • 发布日期:2017-04-09
    • 文件大小:792
    • 提供者:wang
  1. newcode

    0下载:
  2. ram block discr iption ,which are fullfill all kind of fuction that you need-ram block discr iption, which are fullfill all kind of fuction that you need
  3. 所属分类:software engineering

    • 发布日期:2017-05-15
    • 文件大小:4085308
    • 提供者:wang
  1. fpadd

    0下载:
  2. It is the floating point data type adder!
  3. 所属分类:software engineering

    • 发布日期:2017-04-10
    • 文件大小:1968559
    • 提供者:lo-po
  1. Altera_Proj

    0下载:
  2. altera nios ii ide c code
  3. 所属分类:software engineering

    • 发布日期:2017-05-25
    • 文件大小:8522762
    • 提供者:himanshu
  1. UartvhdlSilmlate

    0下载:
  2. Universal Asynchronous Receiver
  3. 所属分类:Communication

    • 发布日期:2017-04-17
    • 文件大小:8793
    • 提供者:Kouroush
  1. write

    0下载:
  2. VHDL语言编写的IIC总线通信的写操作的底层程序-VHDL language of the IIC bus communication of the write operation of the underlying process
  3. 所属分类:software engineering

    • 发布日期:2017-03-27
    • 文件大小:523
    • 提供者:何美枝
  1. paobiao

    0下载:
  2. 实现数字跑表功能,该跑表具有复位、暂停、秒表计时等功能。-Digital stopwatch function, the stopwatch with a reset, pause, stopwatch timer functions.
  3. 所属分类:software engineering

    • 发布日期:2017-04-16
    • 文件大小:483435
    • 提供者:刘新
  1. 81404622Released-FPGA-CODE-AD9289-RevD

    0下载:
  2. 直接用FPGA实现AD转换,方便快捷,不需要额外的接线-It s very easy to use AD through FPGA
  3. 所属分类:Document

    • 发布日期:2017-04-08
    • 文件大小:339524
    • 提供者:zhanglin
  1. median

    0下载:
  2. 中值滤波的实现,该代码使用的是verilog 语言 module median(clk,reset,load,din,mult,dout,over,a3,b3,c3,a2,b2,c2,a1,b1,c1)-Median filter implementation, the code using verilog language module median (clk, reset, load, din, mult, dout, over, a3, b3, c3, a2, b2, c2, a1,
  3. 所属分类:Project Design

    • 发布日期:2015-07-05
    • 文件大小:2305
    • 提供者:刘文英
  1. counter

    0下载:
  2. 计数器,可以重复记录计算数字。二进制计数。有重复。-Counter
  3. 所属分类:software engineering

    • 发布日期:2017-04-07
    • 文件大小:694
    • 提供者:xu
  1. FIFO_Buffer

    0下载:
  2. 很关键的用的多的SRAM控制程序,在数据采集中很重要,对大家有帮助-Very critical of the number of SRAM with the control procedures, in the data collection a very important help to everyone
  3. 所属分类:software engineering

    • 发布日期:2017-04-01
    • 文件大小:649
    • 提供者:wangyl
  1. irda.tar

    0下载:
  2. depends on irda transmitter recever
  3. 所属分类:Communication

    • 发布日期:2017-03-27
    • 文件大小:952320
    • 提供者:david
  1. can-verilog

    0下载:
  2. 汽车工业系统里面的电气设备常用的总线控制-Automotive systems commonly used in electrical equipment inside the bus control
  3. 所属分类:software engineering

    • 发布日期:2017-04-01
    • 文件大小:538095
    • 提供者:sangpeng
  1. INTRACODES

    0下载:
  2. H.264 intraprediction
  3. 所属分类:Project Design

    • 发布日期:2017-04-09
    • 文件大小:23055
    • 提供者:shb
  1. uart

    0下载:
  2. 异步串行接口设计 vhdl设计 fpga下载模拟-this is a vhdl programm
  3. 所属分类:File Formats

    • 发布日期:2017-04-02
    • 文件大小:10312
    • 提供者:jack
  1. fifo_template

    0下载:
  2. aes code with fifo control to memory
  3. 所属分类:Project Design

    • 发布日期:2017-03-29
    • 文件大小:8995
    • 提供者:allen
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