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  1. KL

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  2. K-L人脸识别,根据训练库中的训练数据。把输入的人脸进行匹配,所采用的算法为K-L算法-K-L face recognition, according to the training data in the training . The input face matching, the algorithm used for the K-L algorithm
  3. 所属分类:Graph Recognize

    • 发布日期:2017-05-04
    • 文件大小:418.05kb
    • 提供者:张栎存
  1. codes

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  2. CombineImages: Combine two images to get 1. dft:Discrete Fourier Transform equation GetHist:To get the histogram of any image RGBTOGRAYCONVERTER:Convert a RGB image to a gray scale tecnicaBSS: Code to aply the blind source separation tecnique
  3. 所属分类:matlab

    • 发布日期:2017-04-13
    • 文件大小:1.94kb
    • 提供者:Aniela
  1. STM32-MP3

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  2. 一款自行编写的用C语言开发的,基于战舰STM32板子的MP3-A self-written MP3 using C language, based on the battleship STM32 board
  3. 所属分类:Other Embeded program

    • 发布日期:2017-06-16
    • 文件大小:23.21mb
    • 提供者:
  1. STM32BLDC

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  2. 基于STM32的双闭控制直流无刷电机BLDC-Based on the STM32 dual closed control brushless DC motor BLDC
  3. 所属分类:SCM

    • 发布日期:2017-05-04
    • 文件大小:419.12kb
    • 提供者:anny
  1. BLDC

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  2. 无刷电机无霍尔传感控制器例程,使用的芯片是飞思卡尔的KE02Z-Brushless motor without Hall sensor controller routines, using the chip is Freescale s KE02Z
  3. 所属分类:SCM

    • 发布日期:2017-05-30
    • 文件大小:12.19mb
    • 提供者:anny
  1. upsampler

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  2. 一个用VHDL自行编写的完整可行的增采样系统,仅供参考-VHDL with a self-preparation of a complete and feasible by sampling system, for reference only
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.75mb
    • 提供者:
  1. EasyUI

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  2. EasyUI自由桌面功能, - EasyUI Free Desktop Features EasyUI Free Desktop Features
  3. 所属分类:CSharp

    • 发布日期:2017-05-07
    • 文件大小:1.02mb
    • 提供者:jie
  1. imageSaliency-master

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  2. 图像显著区域识别算法 可以运行 matlab 超像素分割-salient detection
  3. 所属分类:Special Effects

    • 发布日期:2017-06-21
    • 文件大小:34.16mb
    • 提供者:冬青
  1. shift_register

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  2. 用VHDL编写的简单明了的位移寄存器,仅供参考。-Prepared using VHDL simple shift register for reference purposes only.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-05
    • 文件大小:203.39kb
    • 提供者:
  1. Serial-input--parallel-output

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  2. 关于VHDL的一个问题。串行输入64位二进制数,要求把数据按每8位存在8个寄存器中并行输出-A question about the VHDL. Serial input 64-bit binary number is required for every eight data registers the presence of eight parallel outputs
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:959byte
    • 提供者:
  1. Digital-tube-display

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  2. 一种用VHDL写的数码管扫描电路,简单明了,仅供参考-One kind with VHDL written digital scanning circuit, plain and simple, for reference only
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:144.4kb
    • 提供者:
  1. SED2

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  2. 超像素分割 毕业论文 matlab源代码-SDE SUPERPIXEL SEGMENT
  3. 所属分类:Special Effects

    • 发布日期:2017-05-13
    • 文件大小:2.89mb
    • 提供者:冬青
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