资源列表
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- 《数字滤波器的MATLAB与FPGA实现：Altera Verilog版》——杜勇前五章(Realization of digital filter with MATLAB and FPGA: Altera Verilog version)
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- 《数字滤波器的MATLAB与FPGA实现：Altera Verilog版》——杜勇六到九章pdf(Realization of digital filter with MATLAB and FPGA: Altera Verilog version)
hdmi
- 滚动彩条显示。通过HDMI接口输出单色图案、渐变色、单幅马赛克、动态马赛克等图案。使用Verilog，基于Xilinx Spartan-6 LX45器件，AX6045开发板(Scroll bar display. Through HDMI interface output monochrome pattern, gradient color, single mosaic, dynamic mosaic and other patterns. Using Verilog, based on Xil
spi
- spi的串口简单数据通信实验，实现数据发送(SPI serial port simple data communication experiment, to achieve data transmission)
222
- VHDL BISS,SSI,ENDAT2.2, ENCODER
EDA-2
- 数字电子技术基础课程的第二次EDA作业，内容是投币充电仪。(The second EDA assignment of basic course of digital electronic technology is coin charger.)
08_1_hdmi_output_test
- HDMI输出彩条测试程序，在赛灵思平台有过验证，可以显示1920×1080分辨率30帧得图像(HDMI output color bar test program verified on Xilinx platform)
数字预失真
- 采用VHDL编写的数字预失真模块，主要用于提高功放效率
i2c_verilog
- 主要包含i2c的master、slave模块，和一个简单的仿真sim文件(It mainly includes I2C master, slave module, and a simple SIM file)
test_ddr3
- 基于XILINX K7系列FPGA实现5120*5120分辨率20帧的DDR3读写，发送到海思3559,HDMI显示。(Based on Xilinx K7 series FPGA to achieve 5120*5120 resolution of 20 frames of DDR3 read and write, sent to the Hays 3559,HDMI display.)
SPI接口Verilog实现
- 里面有主机发送模块和从机接收模块。主机发送32位16进制数（一位一位发送），工作在模式0。压缩文件内代码可直接运行，另附上testbench文件可以进行modelsim仿真。此代码根据论坛里一位大哥的代码改编，后来找不到是谁了。。。使用状态机编写主机的发送模块，由于项目仅仅需要主机发送所以从机的接收模块没有写成32位的，但是代码风格清晰，可以直接修改，复写率极高且非常好理解！
ad7691
- ad7691驱动文件，包含ip和源文件ad7691驱动文件，包含ip和源文件ad7691驱动文件，包含ip和源文件