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  1. sp6ex1

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  2. 时钟二分频实例,详细介绍ISE中如何新建工程、创建并编辑源代码文件、进行语法检查、调用ModelSim进行功能仿真。-Clock two examples, detailed introduction of how to create a new project in ISE, create and edit the source code files, syntax checking, call ModelSim function simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1003.91kb
    • 提供者:chi
  1. sp6ex2

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  2. PWM蜂鸣器驱动实例,产生频率为25Hz,占空比为50 的蜂鸣器发声信号;同时详细介绍USB下载线的连接与驱动安装,进行板级的代码在线调试和固化-PWM buzzer driver instance, the frequency of 25Hz, duty cycle of 50 of the buzzer sound signal at the same time the USB download line connection and driver installation, the b
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:315.24kb
    • 提供者:chi
  1. sp6ex3

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  2. 蜂鸣器开关实例,拨码开关SW3的ON和OFF状态对应控制蜂鸣器响或不响-Buzzer switch instance, the dial switch ON SW3 and OFF state corresponding control buzzer sound or not
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:122.38kb
    • 提供者:chi
  1. sp6ex4

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  2. 流水灯实例,8个LED循环点亮,实现流水灯效果-Example of water lights, 8 LED cycle lit, to achieve the effect of water lights
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:181.64kb
    • 提供者:chi
  1. sp6ex5

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  2. 3-8译码器实验,用三个拨码开关控制8个LED中某一个点亮-3-8 decoder experiment, with three dial switch control 8 LED in a certain light
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:148.56kb
    • 提供者:chi
  1. sp6ex6

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  2. 按键消抖与LED开关实例,5个导航按键的按下与 否,对应控制LED D2/D3/D4/D5/D6的亮灭切换-Key debounce switch with LED example, 5 navigation keys and press No, the corresponding LED control D2/D3/D4/D5/D6 light off switch
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:221.92kb
    • 提供者:chi
  1. vivado_LED_Flow

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  2. 本例程使用vivado2014.4工具,利用xilinx Basys3 实验板实现板载流水灯的两种模式控制。-This project uses verilog HDL to realize the the control of 16 leds loaded on Xilinx Basys3 board.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:628.16kb
    • 提供者:姚罡
  1. SegSimplified

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  2. 本工程使用verilog HDL和vivado2014集成开发环境实现利用xilinx Basys3开发板上4位数码管显示从0到9999的计数器功能。-This project uses verilog HDL to realise counting 0 to 9999 on the 7-seg LED loaded on Xilinx Basys3 board.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.15mb
    • 提供者:姚罡
  1. yimaqi38

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  2. 基于CPLD的38译码器程序设计,使用VHDL语言编程,38译码器显示在数码管上。-CPLD programming decoder 38 based on the use of VHDL language programming, the decoder 38 is displayed on the digital tube.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:127.93kb
    • 提供者:孙大幕
  1. liushuideng

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  2. 基于CPLD的流水灯实现,使用VHDL语言编程,闪烁间隔为0.5秒。-CPLD-based water lights to achieve using VHDL language programming, blinking interval of 0.5 seconds.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:55.53kb
    • 提供者:孙大幕
  1. honglvdeng

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  2. 基于CPLD的交通信号灯的实现,使用VHDL语言,使用不同颜色的二极管分别代表红黄绿三种信号灯。在数码管上可以分别显示倒计时。-CPLD-based implementation of the traffic lights, the use of VHDL language, using different colors of red yellow and green diodes representing three kinds of lights. On the digital countd
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.04mb
    • 提供者:孙大幕
  1. bujinji-(kuozhan)

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  2. 基于CPLD的步进电机控制实现,使用VHDL语言进行编程,通过控制开关,可以实现正转快速,正转慢速,反转快速,反转慢速四种不同的状态。- Based on CPLD stepper motor control implementation using VHDL language programming, by controlling the switch, you can achieve fast forward, slow forward, fast reverse, reverse sl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:73.25kb
    • 提供者:孙大幕
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