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  1. SPIBusVerilog.rar

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  2. SPI串行总线接口的Verilog实现,详细讲解实现过程。,SPI serial bus interface Verilog realization elaborate on the realization of the process.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:388.77kb
    • 提供者:zhlm88
  1. RSdecoder.rar

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  2. cpld/fpga RS(204,188)译码器的verilog程序,cpld/fpga RS (204,188) decoder of the Verilog program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:13.46kb
    • 提供者:陈臣
  1. 6tapFIR.rar

    0下载:
  2. 6阶FIR+verliog+分布式算法(DA),6 bands FIR+ Verliog+ Distributed Arithmetic (DA)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:2.06kb
    • 提供者:zs
  1. Serial.rar

    0下载:
  2. 基于MAX2运用Quartus实现串口通信,MAX2-based use of Quartus Serial Communication
  3. 所属分类:VHDL编程

    • 发布日期:2017-04-01
    • 文件大小:559.14kb
    • 提供者:翡翡
  1. Verilog.rar

    0下载:
  2. FPGA开发,Verilog的经典教程,在嵌入式培训中的电子书籍。,FPGA development, Verilog classic Guide, in the embedded training e-books.
  3. 所属分类:VHDL编程

    • 发布日期:2017-05-16
    • 文件大小:3.98mb
    • 提供者:郑佳
  1. FPGACOM.rar

    1下载:
  2. FPGA编程实现串口通信,源代码全。包括仿真程序。,FPGA programming serial communications, the entire source code. Including the simulation program.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:1.24kb
    • 提供者:duncan
  1. keydebounce.rar

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  2. FPGA中按键弹跳消除模块的研究与应用,原理和例子都非常好,FPGA to eliminate bounce in key research and application modules, principles and examples are very good
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:224.87kb
    • 提供者:mcuxxq
  1. 数字频率计VHDL程序与仿真

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  2. 数字频率计VHDL程序与仿真 文件名:plj.vhd。 --功能:频率计。具有4位显示,能自动根据7位十进制计数的结果,自动选择有效数据的 --高4位进行动态显示。小数点表示是千位,即KHz。 ,Digital Cymometer VHDL procedures and simulation of the file name: plj.vhd.- Function: frequency meter. With four shows that will automatically coun
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-23
    • 文件大小:97.84kb
    • 提供者:小草
  1. pinluji.rar

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  2. 四位十进制频率计设计 包含测频控制器(TESTCTL),4位锁存器(REG4B),十进制计数器(CNT10)的原程序(vhd),波形文件(wmf ),包装后的元件(bsf)。顶层原理图文件(Block1.bdf)和波形。 ,Four decimal frequency meter measuring frequency controller design includes (TESTCTL), 4 bit latch (REG4B), decimal counter (CNT10) of t
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:10.98kb
    • 提供者:深空
  1. c17_GF_multiple.rar

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  2. 精通verilog HDL语言编程源码之3--伽罗华域乘法器设计,Proficient in language programming verilog HDL source of 3- Galois field multiplier design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:1.65kb
    • 提供者:李平
  1. c18_divider.rar

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  2. 精通verilog HDL语言编程源码之4--常用除法器设计,Proficient in language programming verilog HDL source of 4- Common divider design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1.69kb
    • 提供者:李平
  1. c22_FIFO.rar

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  2. 精通verilog HDL语言编程源码之8——异步FIFO设计,Proficient in language programming verilog HDL source of 8- Asynchronous FIFO Design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2.56kb
    • 提供者:李平
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