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  1. vhdl

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  2. 用状态机检测1001序列的vhdl代码 1001 sequence detection using the state machine vhdl code-1001 sequence detection using the state machine vhdl code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:647byte
    • 提供者:于丁
  1. jiaotongdeng

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  2. 实现十字路口红绿灯指示功能,红绿灯不同时间倒计时显示,包含VHDL编写的主要器件,和下载扫描电路。-Functions to achieve a crossroads traffic lights, traffic lights and countdown at different times, including the preparation of the main components VHDL, and download scanning circuit.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:446.48kb
    • 提供者:lijinrun
  1. Example-b3-1

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  2. UART串口加法计数器的使用,用verilog语言编写 -the use of UART serial addition counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.22mb
    • 提供者:田甜
  1. SRAM

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  2. VerilogHDL语言读写SRAM内部数据。SRAM芯片型号为61WV102416ALL,即1024K字,每字16位,共16Mb。工作在100MHz频率下。-VerilogHDL language to read and write internal data SRAM. SRAM chip model 61WV102416ALL, ie 1024K words, each word 16, a total of 16Mb. Work in the 100MHz frequency.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:2.26kb
    • 提供者:于潇宇
  1. S9_PS2_LCD

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  2. ps2+12864,verilog源代码-ps2+12864, verilog source code. .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:758.53kb
    • 提供者:王半田
  1. SPI3_8bit

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  2. 一整套通用的用Verilog代码实现的SPI3接口(8bit接口)协议代码,包含ISE工程文件,本代码在Xilinx公司的FPGA上实现,并且有Modelsim仿真的源文件-SPI3 verilog code(including ISE project and modelsim code)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2.7mb
    • 提供者:yaofan
  1. SPI_Master

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  2. verilog HDL 语言描述的8位并行转SPI程序-verilog HDL language descr iption of the 8-bit parallel transfer SPI program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:1.4kb
    • 提供者:叶伟
  1. verilog_show10

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  2. 基于VHDL编写的10进制显示输出,基于16进制的10进制控制,适合初学者-VHDL-based display output written in decimal, hexadecimal, 10 hexadecimal-based control, suitable for beginners
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:265.64kb
    • 提供者:Geyufei
  1. V3(2)

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  2. 设计一个7段数码管译码器,带数码管的4位可逆计数器 [具体要求] 1. 7段数码管译码器 使用拨码开关SW3, SW2, SW1, SW0作为输入,SW3为高位,SW0为低位。 将输出的结果在HEX1,HEX0显示。当输入为‘0000’~‘1111’显示为00~15, 2. 带数码管的4位可逆计数器 将实验三的结果在数码管上显示。结合上次实验,将4位可逆计数器,数码管显示,分别作为两个子模块,实现在数码管上显示的4位可逆计数器。-Design of a 7-s
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:326.62kb
    • 提供者:weijian
  1. cpu_vh

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  2. 一个大学计算机组成原理CPU的课程设计,比一般的CPU的课程设计多了几种寻址方式,总共六种寻址方式,对CPU的内部问题能有很深的了解。-Principles of Computer CPU of a university curriculum design, the CPU than the average of several courses designed to address multi-mode, a total of six addressing modes, the CPU'
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.31mb
    • 提供者:
  1. fft

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  2. 一个fft算法的应用,对于初学者对于FFT算法的应用有了很大的帮助-The application of a fft algorithm, FFT algorithm for the application for beginners has been a great help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-18
    • 文件大小:26.58mb
    • 提供者:jibaozhang
  1. frequency

    0下载:
  2. 一个三位或者多位十进制数字式频率计,量程为1KHZ到99MHZ,可以自动换挡-More than three decimal digits or a frequency meter, the measuring range 1KHZ to 99MHZ, you can automatically shift
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:267.93kb
    • 提供者:guo
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