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  1. XC95288-optical-cable-host

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  2. 本程序是基于Xilinx的CPLD95288芯片开发的光线通讯,AD7656AD采集功能的主机程序。-This procedure is a host-based communications program light of CPLD95288 Xilinx chip development, AD7656AD capture capability.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.67kb
    • 提供者:杜含宇
  1. XC95288-optical-cable-slave

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  2. 本程序是基于Xilinx的CPLD95288芯片开发的光线通讯,AD7656AD采集功能的从机程序。-This procedure is based on Xilinx s CPLD95288 light communication chip development, AD7656AD acquisition the program.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.29kb
    • 提供者:杜含宇
  1. VGA汉字显示

    0下载:
  2. FPGA利用Verilog语言在Cyclon II器件上进行开发的VGA汉字显示.
  3. 所属分类:VHDL编程

    • 发布日期:2015-05-12
    • 文件大小:541.06kb
    • 提供者:dandelion4277
  1. pll_zsy.v

    0下载:
  2. 全数字锁相环程序 此程序基于VHDL编写 可以完成相关功能-All digital phase-locked loop based on VHDL write program this program can complete the relevant function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:374.39kb
    • 提供者:赵政桐
  1. fir_s

    0下载:
  2. FIR滤波器源代码 以及例化图和波形仿真图-FIR filter source code and instantiated figure and waveform simulation diagram
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:377.78kb
    • 提供者:孙旭丽
  1. cordic_new

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  2. cordic algorithm project.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:229.16kb
    • 提供者:cuong
  1. 123455

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  2. 32位累加器,包括32位加法器与寄存器,程序与仿真文件包含在内,在相应的环境下可直接运行-32-bit accumulator, including 32-bit adder and register, procedures and simulation files included, can be run directly under the corresponding environment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:194.39kb
    • 提供者:chaoshui
  1. 123456789

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  2. 波形存储器的设计,利用文件中VHDL可以加载一定的波形数据,文件包含可直接运行的仿真图-Waveform memory design using VHDL file can load some of the waveform data files contain simulation can be run directly Figure
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-27
    • 文件大小:336.2kb
    • 提供者:chaoshui
  1. NCO

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  2. 基于FPGA的DDS设计,通过外接DA转换器输出稳定的正弦波,方波和三角波,可单独产生时钟,不必借助硬件连接,包含寄存器程序,累加器程序和时钟发生电路等,以及顶层设计原理图-The DDS FPGA-based design, through an external DA converter output stable sine wave, square wave and triangular wave, can produce a single clock, without the help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:5.56mb
    • 提供者:孙雨晗
  1. 1302

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  2. DS1302时钟芯片控制程序。在数码管上显示时间。-DS1302 clock chip control procedures. In the digital tube display time.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:422.09kb
    • 提供者:孙帅斌
  1. SUN

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  2. 基于nios的点阵贪吃蛇游戏设计,可外接PS2小键盘操作游戏-Nios based on lattice Snake game, you can add a small keyboard PS2 games
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-02
    • 文件大小:13.84mb
    • 提供者:lanxiaojun
  1. Lab7

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  2. Adder Substrator 能夠顯示在FPGA上並且能夠實際作加減 可做signed int -Adder Substrator
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-27
    • 文件大小:13.97kb
    • 提供者:夏宇婕
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