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  1. hdl

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  2. ACTEL FPGA 6位数码管计数999999,Verilog描述-ACTEL FPGA 6 bits digital tube count 999999, Verilog descr iption
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:2.59kb
    • 提供者:gouyouwen
  1. Compare_4bit_74hc85

    0下载:
  2. ACTEL FPGA 74HC85实例演示,Verilog描述-ACTEL FPGA 74HC85 examples demonstrate, Verilog descr iption
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:15.52kb
    • 提供者:gouyouwen
  1. traffic

    0下载:
  2. 采用VHDL语言编写的控制交通灯工作的程序。分为四个部分:1,分频器,2,计数并产生控制信号,3,交通灯信号产生,4,交通灯总体描述。点击lzh6.aws打开工作空间-VHDL language used to control traffic lights work procedures. Divided into four parts: 1, divider, 2, count and generates control signals, 3, traffic signal generatio
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:20.02kb
    • 提供者:李修函
  1. date

    0下载:
  2. Verylog HDL实现数字时钟,没有小时,如果需要可以自己该一下-Verylog HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:281.42kb
    • 提供者:TG
  1. filipe

    0下载:
  2. Elevator descr iption in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

  1. elecfans.com-EP1C3T100

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  2. 引脚功能说明,FPGA的管脚希望大家好好努力,希望对大家有帮助。-thank
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:207.19kb
    • 提供者:孙艳玲
  1. VHDL_Examples_foreducation

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  2. 一些Verylog HDL的小程序,自己琢磨一下啊-VERYLOG HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:58.57kb
    • 提供者:TG
  1. veriloghdl110

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  2. Verylog HDL 程序,喜欢的朋友可以拿去看一下啊-Verylog HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:171.34kb
    • 提供者:TG
  1. FPGA_design_study

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  2. Verylog HDL 程序,喜欢的朋友可以拿去看一下-Verylog HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:213.15kb
    • 提供者:TG
  1. Verilogintrc1

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  2. Verylog HDL 一些小程序,可以借鉴一下-Verylog HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:259kb
    • 提供者:TG
  1. vhdlEXAMPLE

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  2. VHDL 的一些程序,看一下-VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:228.69kb
    • 提供者:TG
  1. displayHELLO

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  2. verilog语言编写,在altera公司的de2实验板上实现八个数码管循环显示HELLO-verilog language, in the experimental altera de2 board to achieve the company' s eight digital control loop shown HELLO
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:1.78kb
    • 提供者:luping
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