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  1. launch

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  2. 基于EP1C6Q240 FPGA 核心板的 红外 发射 接收 扩展板 的PCB SCH 的设计文档,红外发射采用PT2248芯片 完成,调制方式 PCM,红外接收采用接收一体头 完成送 FPGA 解码 后 在扩展板的 数码管模块上显示相应内容-EP1C6Q240 FPGA board based on the core of infrared transmitting and receiving expansion board PCB SCH design documents, infrared
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:182.65kb
    • 提供者:明年此时
  1. tongxin

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  2. 自己做的测频测相器(硬件使用EPM240采样计数mega16取数和控制),此为EPM240的程序,使用quartus编程,主要包含两个接近20位的计数器。-This is the frequency and phase detector (hardware using EPM240 sampling and counting, mega16 take the number and control), this is EPM240 procedures, using quartus program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:173.42kb
    • 提供者:黎鑫
  1. SRAM_2

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  2. fpga(veriloh hdl)编写的SDRAM程序 -fpga(veriloh hdl)SDRAM
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:98.13kb
    • 提供者:SHIGANG
  1. Verilog-DRAM

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  2. fpga(veriloh hdl)编写的SDRAM程序说明 -fpga(veriloh hdl)SDRAM
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.6mb
    • 提供者:SHIGANG
  1. dfdfd

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  2. hello fpga project hello fpga project-hello fpga project hello fpga project hello fpga project
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:123.66kb
    • 提供者:ANNIYAN
  1. VHDL_CXSL

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  2. vhdl 讲解,扫描版PDF VHDL_CXSL-vhdl explain, scan version PDF VHDL_CXSL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2.84mb
    • 提供者:丁云
  1. FPGA

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  2. FPGA设计指南:器件、工具和流程 一本好书,介绍FPGA的基础知识。-FPGA Design Guide: devices, tools and processes, a good book to introduce the basics of FPGA.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-13
    • 文件大小:19.15mb
    • 提供者:wangmingsheng
  1. yingyuzimuxianshi

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  2. 用VHDL语言编写的英语字母显示电路,经过验证-VHDL language with the English alphabet display circuit, proven
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:9.6kb
    • 提供者:
  1. maikuantiaozhifashengqi

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  2. VHDL语言编写的正负脉宽数控调制信号发生器-VHDL language of the positive and negative pulse-width modulated signal generator NC
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:8.64kb
    • 提供者:
  1. bianbuchangjiajiancount

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  2. 源码,VHDL语言编写的可变步长加减计数器-VHDL language variable-step addition and subtraction counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:5.85kb
    • 提供者:
  1. 74LS160

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  2. 源码,VHDL语言编写的74LS160计数器-Source code, VHDL language of the 74LS160 counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:48.93kb
    • 提供者:
  1. Adder4

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  2. 源码,内容是用VHDL语言编写的四位全加器-Source code, using VHDL language of the four full-adder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:5.19kb
    • 提供者:
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