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  1. Modelsim_QA

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  2. modelsim的一些问题集锦,对于从事FPGA的研发人员很有帮助-Collection of some of the problems modelsim for personnel engaged in R & D FPGA helpful
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:761.32kb
    • 提供者:fu
  1. pro001_buzzer

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  2. 使用FPGA控制蜂鸣器的程序,用Verilog HDL设计,可以是蜂鸣器发出各种不同的声音-FPGA use buzzer control procedures, using Verilog HDL design, it is the buzzer sounded different voices
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:761.35kb
    • 提供者:wpb3dm
  1. LCDandSDRAM-test

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  2. 一个SOPC实验,关于LCD的控制和SDRAM的使用方法-A SOPC experiment on LCD of control and the use of SDRAM
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:761.41kb
    • 提供者:狗狗
  1. Mentor(Modelsim)

    0下载:
  2. 原言语名字是MODELSIM百问.是一些常见的使用过程中出现的问题.希望对大家有用处.谢谢.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:761.45kb
    • 提供者:madder
  1. lcd

    0下载:
  2. 在和众达SEED-XDTK平台上,基于XC4Vsx25的液晶驱动程序。-In and Jones SEED-XDTK platform, based on XC4Vsx25 liquid crystal driver.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:761.48kb
    • 提供者:hechao
  1. Cursor

    0下载:
  2. ALTERA的DE2平台VGA接口应用,由KEY0-KEY3控制上下左右,使屏幕上光标移动,由Verilog描述。
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:761.52kb
    • 提供者:徐朝凯
  1. VHDL-Cursor

    0下载:
  2. 针对FPGA,采用硬件描述语言VHDL实现光标移动-For FPGA, using hardware descr iption language VHDL realization cursor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:761.53kb
    • 提供者:rain
  1. Lab_ISE_Led

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  2. vhdl实例教程,其中的例子适合新手演示使用,肯定会有帮助的。-VHDL example tutorial, an example of the use for novice demo, it will certainly help.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:761.56kb
    • 提供者:ghjghj
  1. modelesim_entry_written

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  2. modelesim 入门讲解 从新建 编写 综合仿真 观察波形 图层 很具体的讲解-modelesim entry written comprehensive simulation to explain the new observations from the waveform to explain a very specific layer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:761.58kb
    • 提供者:jelly
  1. modelsim-start

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  2. modelsim 入门,开发软件入门教程-Getting Started with modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:761.59kb
    • 提供者:吴林
  1. ADC_AD7490

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  2. THIS PROJECT IMPLEMENTED ON VITERX 4 FPGA and THE COMPLETE SOURCE FILES testbench, design file UCF file are there and THIS ADC is maily configured with SPI protocol interface SPI CLK,SPI DATA, SPI LE, the SPEED OF OPERATION OF SPI CLK is 10 MHZ
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:761.6kb
    • 提供者:LEE
  1. instance_f_meter

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  2. 用元件例化的方法实现了频率计的设计,采用的是Verilog语言,实现了较准确的频率测量的功能,最高测量频率可以达到50M左右。-Case of the method of components to achieve a frequency meter design, the use of the Verilog language, to achieve a more accurate frequency measurement function, the maximum measurement
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:761.66kb
    • 提供者:赵振
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