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  1. Qsys_nios2

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  2. 本教程使用最新的Quartus 11.0sp1+Nios 11.0sp1开发工具。在最新的Quartus II软件中,使用了全新的Qsys进行SOPC系统的构建。 较之以前版本使用SOPC Builder构建有了很大的不同。 本教程为Altera最新的官方Tutorial。 一步步教你使用Qsys构建Nios II系统,并使用Nios II SBT开发应用程序。-This tutorial uses the latest Quartus 11.0sp1+ Nios 11.0sp1 d
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-25
    • 文件大小:2.25mb
    • 提供者:
  1. CLOCK

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  2. 内含数字钟程序,程序准确,请大家放心下载-Includes digital clock program, the program is accurate, please rest assured download
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.25mb
    • 提供者:博远
  1. SDR_SDRAM_IP

    0下载:
  2. SDR SDRAM 控制器,Altera官网重要资料。内涵说明文档,和VHDL与Verilog两种设计IP。-SDR SDRAM controller from Altera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.25mb
    • 提供者:peteryu010
  1. 8086FPGA

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  2. xilinx ise 7.1下 实现sparten3 basys板上基于8086FPGA软核的吃豆子游戏
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.25mb
    • 提供者:朱万里
  1. pci_bridge

    0下载:
  2. 基于WISHBONE的pci桥实现,包括功能模块和测试模块-Based on the pci bridge WISHBONE implementation, including functional modules and test modules
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.25mb
    • 提供者:敬笑
  1. sdram_ok

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  2. sdram + FPGA sdram + FPGA sdram + FPGA-sdram+ FPGAsdram+ FPGAsdram+ FPGAsdram+ FPGAsdram+ FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.25mb
    • 提供者:cuiyifan
  1. xapp485

    0下载:
  2. XAPP485 - 以高达 666 Mbps 的速率在 Spartan-3E FPGA 中实现 1:7 的解串行化
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.25mb
    • 提供者:mickwolf
  1. caijing

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  2. 这个是加密U盘的VHDL的源程序兼教学辅导,很具有实用性-U disk that is encrypted VHDL source program and coaching, it is practical
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.25mb
    • 提供者:张慧慧
  1. cpu_design

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  2. 简单的CPU设计数字系统实验,使用的是精简指令,水平代码生成
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.25mb
    • 提供者:violet
  1. class12

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  2. uart串口接收模块,对接收的数据串转并-Uart serial port receiving module, the received data string and turn
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-12
    • 文件大小:2.26mb
    • 提供者:bh
  1. sdr_sdram_controller

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  2. 使用verilog和VHDL实现 sdram_controller,代码清晰,测试过可以使用。-sdram_controller verilog vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.26mb
    • 提供者:gyj
  1. FPGA_DDS

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  2. 用FPGA实现DDS双通道信号发生器,具有调相功能-With FPGA realizing double channel DDS signal generator, has the function of system.all
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:2.26mb
    • 提供者:覃祖枢
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