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  1. sdram

    0下载:
  2. SDRAM ctrller 用于SDRAM控制器的读写控制,利用4个 FIFO实现读写数据的缓存。-sdram ctrl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:181.83kb
    • 提供者:张朋
  1. Solomon

    0下载:
  2. Solomon Decoder in verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-23
    • 文件大小:13.95kb
    • 提供者:Sarang
  1. protel_2004

    0下载:
  2. DXP2004一本书籍中对应的一些程序,有利于初学者的学习-DXP2004 a number of books in the corresponding procedures, help beginners learn
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-29
    • 文件大小:52.39mb
    • 提供者:小奚
  1. timing_constraints_ug

    0下载:
  2. xilinx timing constrain file
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:774.34kb
    • 提供者:Daniel
  1. FoxBone_PWM1

    0下载:
  2. This file is consist of VHDL regarding PWM Driver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:90.85kb
    • 提供者:changkyu
  1. conformPulse

    0下载:
  2. 本程序实现了对两相混合式电机提供4路驱动信号,相位相差90,180,另外也提供了拨码开关控制的频率输出选择,输出频率最大是5M,外部全局时钟是10M,采用的芯片是epm7128slc-84-15, 管脚分配可以参考管脚分配文件,对应驱动电机信号是两相双极性A+,A-,B+,B-. 编译环境是quartusII 8.0,这段代码可用来调试步进电机双桥驱动电路,也可用当信号发生器使用。-The program realization of two-phase hybrid motor provide
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:26.84kb
    • 提供者:lijunke
  1. ILI9221DS_V0.5.RAR

    0下载:
  2. ILI9221 LCD datasheet
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.19mb
    • 提供者:-VSD-
  1. HuaweiEDKStudyPPT

    0下载:
  2. 华为EDK学习资料,详细讲解EDK的各种知识。-Huawei EDK learning materials, explain in detail the various knowledge EDK.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:4.85mb
    • 提供者:wuzongyuan
  1. ps2andverilog

    0下载:
  2. 仿真已通过验证,并下载到FPGA实验板测试,大家可以下载来学习-Simulation has been validated, and downloaded to the FPGA test board test, you can download to learn ~~~~~
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:487.19kb
    • 提供者:谢虎
  1. dianzhen

    0下载:
  2. 256 级灰度LED 点阵屏显示原理及基于FPGA 的电路设计-256 grayscale screen display LED dot matrix theory and circuit design based on FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:127.63kb
    • 提供者:L
  1. miaobaoandverilog

    0下载:
  2. 非常好的程序代码,大家可以下载下来学习及参考,已通过验证-Very good code, you can download and reference study has validated ~~~~~
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:125.74kb
    • 提供者:谢虎
  1. clock

    0下载:
  2. 用vhdl做的数字时钟,里面含有很详细的报告哦!-Vhdl do with digital clock, which contains a very detailed report on the Oh!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.35mb
    • 提供者:deng
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