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  1. VHDLpaomadeng

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  2. 通过VHDL语言来实现类似跑马灯的控制,通过高电平的转移来实现灯光的转移,利用QuartusII开发平台-Through the VHDL language to achieve similar Marquee control, transfer through the high level to achieve the transfer of light, using QuartusII development platform
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:569byte
    • 提供者:常云飞
  1. TestFre

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  2. 通过时钟分频,用PWM脉冲调宽来控制LED灯亮度的强弱,改变PWM的占空比来实现恒流LED的亮度强弱控制-By the clock frequency, pulse width modulated using PWM to control LED brightness light intensity, changes in PWM duty cycle to achieve constant current LED brightness intensity control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:954byte
    • 提供者:常云飞
  1. serial_bus

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  2. dahua串行总线参考设计,主要是针对dahua公司的器件进行,对于串行总线的开发者来说具有很好的参考价值。-xilinx serial bus reference design, the company mainly for Xilinx devices, the serial bus of the developers who have a very good reference value.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:5.89kb
    • 提供者:关几行
  1. ml50x_cpld_design

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  2. 片具有高性能和低功耗的特点,主要应用在嵌入式系统。MPC7410是新一代G4处理器,通过加入AltiVec技术,处理能力达到4G FLOPS,而1.8 V的低电压操作大大降低了芯片的功耗,提高了系统的稳定性 来源:[http://www.jdzj.com]机电之家·机电行业电子商务平台!-erqwrq
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:14.35kb
    • 提供者:anhaiyang
  1. change

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  2. 同步串并转换程序,1位串行输入,8位并行输出。-Synchronous series and the conversion process, a serial input, 8-bit parallel output.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:7.82mb
    • 提供者:chuck
  1. 8B10BEncodeDecode

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  2. 基于FPGA的8B10B编解码程序,内含编码和解码文件-FPGA-based 8B10B decoding process, encode and decode files containing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:128.06kb
    • 提供者:
  1. FPGA_verilog

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  2. FPGA很有价值的27实例:如ASK、PSK、FSK调制与解调VHDL程序及仿真等-FPGA verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.22mb
    • 提供者:
  1. six_led_display

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  2. 数码管灯控制程序,动态扫描过程。硬件连接方式比较特殊,位选单独控制,又是级联方式。6个数码管。-Digital tube light control applications, dynamic scanning process. Hardware connection is rather special, separate control of Choice, but also a cascade. 6 digital control.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.59kb
    • 提供者:lichenlin
  1. seg_led_display

    0下载:
  2. 数码管灯控制程序,动态扫描过程。硬件连接方式比较特殊,位选单独控制,又是级联方式。6个数码管。-Digital tube light control applications, dynamic scanning process. Hardware connection is rather special, separate control of Choice, but also a cascade. 6 digital control.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:2.59kb
    • 提供者:lichenlin
  1. ringcounter

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  2. 一个实现ringcounter的案例,浅显易懂,适合初学者学习并使用-a ringcounter example
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:289.62kb
    • 提供者:guo zhong
  1. mamta

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  2. the zip file i have uploaded has some testbenches in vhdl for sqare root,sum,subtract
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:3.27kb
    • 提供者:nmamatha
  1. cordicalgorithm

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  2. this zip file contains some details which details how to use coredic algorithm to implement trigonometric functions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2.76mb
    • 提供者:nmamatha
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