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  1. shumaguanxianshi

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  2. vhdl语言实现的数码管显示控制程序段,可实现数码管的扫描显示-It is a displayer control sequence using VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.1kb
    • 提供者:
  1. add8

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  2. 用VHDL语言实现的八位计数器 可进行简单的加减乘除运算-It is a counting device with eight-bit that could plus ,subtract ,multiply and divide.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:2.7kb
    • 提供者:
  1. DigitalClock

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  2. 该数字钟,采用VHDL语言编写,具有即时,跑表,调时,调分,闹铃等功能,另外还可以增加一些功能,例如正点报时等-The digital clock, using VHDL language, with real-time, PaoBiao, adjustable, adjustable, alarm functions, also can add some functions, such as punctual
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.27mb
    • 提供者:fushibin
  1. ss

    0下载:
  2. 交通灯控制VHDL源代码,简洁明了,非常不错。-VHDL source code of traffic light control, concise, very good.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:788byte
    • 提供者:余力
  1. xin

    0下载:
  2. 实现乘法,8位的乘法功能,比较简单实用,能够实现控件开始运算-Achieve multiplication, 8-bit multiplication function is relatively simple and practical, to start operations to achieve control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:960.37kb
    • 提供者:chen
  1. FSKModulatinAndDemodulationProgramingAndSimulation

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  2. 基于VHDL硬件描述语言,对基带信号进行FSK调制解调并进行仿真-VHDL hardware descr iption language based on the base-band signals and simulation FSK modulation and demodulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:52.03kb
    • 提供者:高伟
  1. ElectronicClockAndSimulationOfVHDLProcedures

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  2. 电子时钟VHDL程序与仿真,含有源代码及详细的说明,非常好的参考资料,希望对学习VHDL的人有所帮助-VHDL procedures and simulation of electronic clock, with source code and detailed instructions, very good reference for those who want to learn VHDL help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:58.69kb
    • 提供者:高伟
  1. Verilog

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  2. Verilog 黄金指南Version 1.0, August 1996 书,不是代码-Verilog Golden Guide Version 1.0, August 1996 book, not the code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:272.38kb
    • 提供者:叶才三
  1. DAC902

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  2. DAC902测试 Quartus II 实现的-DAC902 test Quartus II implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:861.81kb
    • 提供者:叶才三
  1. 135classic_example_of_Verilog_design

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  2. Verilog的135个经典设计实例,由简到繁,由浅入深,值得收藏!-Verilog' s 135 classic design example, from simple to complex, Deep and worth collecting!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:110.62kb
    • 提供者:假如
  1. Verilog-HDL

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  2. VerilogHDL实践与应用系统设计随书代码-VerilogHDL practice and application of system design with the code book
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.35mb
    • 提供者:叶才三
  1. KID_ROM

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  2. VHDL实现的只带rom的CISC模型微处理器设计 实现的是输入10个数,输出最小负数-VHDL implementation of the model with only rom the CISC microprocessor designs Realize that the number of input 10 and output the smallest negative
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.8mb
    • 提供者:叶才三
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