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  1. mc8051

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  2. 8051 vhdl source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:17.71kb
    • 提供者:vincent
  1. VGA_2c5

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  2. 用VHDL写的,直接在显示器上显示,分辨率为800*600,-Using VHDL written directly in the display shows that a resolution of 800* 600,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:299.82kb
    • 提供者:zhangxiaobo
  1. UART_VHDL

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  2. 异步串口通信VHDL源代码,通过了验证,最高通信速率可达384-Asynchronous serial communication VHDL source code, through the validation, the maximum communication rate of up to 384
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:11.88kb
    • 提供者:liujl
  1. VHDL

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  2. 本文介绍了 VHDL语言的学习总结,对于有一定VHDL语言基础的同行们 我想应该能起到一定作用。-This paper introduces the VHDL language summary, for a certain language VHDL-based colleagues I would like to be able to play a role.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:148.49kb
    • 提供者:邓忠飞
  1. cpldfpga

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  2. 《CPLDFPGA嵌入式应用开发技术白金手册》源代码-err
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:277.21kb
    • 提供者:cathy
  1. FFT

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  2. FFT的VHDL实现程序 希望对大家有用 -FFT of the VHDL program hope to achieve useful
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:27.51kb
    • 提供者:cathy
  1. 11

    0下载:
  2. 华为FPGA设计流程指南 华为FPGA设计流程指南-FPGA Design Flow Guide Huawei Huawei FPGA Design Flow Guide
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:31.57kb
    • 提供者:cathy
  1. ramvhdllib_06

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  2. The Free IP Project VHDL Free-RAM Core-The Free IP ProjectVHDL Free-RAM Core
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:601.78kb
    • 提供者:cathy
  1. sys_0820

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  2. 使用VHDL语言描述AD0809芯片功能,实现芯片的硬件描述-The use of VHDL language descr iption AD0809 chip function, the realization of chip hardware descr iption
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-28
    • 文件大小:10.41mb
    • 提供者:李冰
  1. sys_0809

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  2. 用VHDL语言描述AD0809芯片,实现AD0809的功能-VHDL language used to describe chip AD0809, AD0809 to achieve the function of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-28
    • 文件大小:10.15mb
    • 提供者:李冰
  1. div16

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  2. 十六位的除法器,采用verilog hdl-16 of the divider using verilog hdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3.03kb
    • 提供者:江浩
  1. ADC_16bit

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  2. 模数变换器,采用verilog hdl编写-Analog-to-digital converters, used to prepare verilog hdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.72kb
    • 提供者:江浩
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