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  1. NiosII_I2C_bus

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  2. 采用altera公司EP3C系列芯片实现的基于Nios II的I2C总线设计,采用Verilog编码-Altera company EP3C using the Nios II series chip I2C bus-based design using Verilog coding
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-01
    • 文件大小:12.89mb
    • 提供者:leeyg
  1. 10_CMOS_OV7725_RGB640480

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  2. 采用FPGA EP4CE开发的OV7725摄像头视频采集系统,采用Verilog实现-Using FPGA EP4CE developed OV7725 camera video capture system, using Verilog realize
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:750.92kb
    • 提供者:leeyg
  1. superdigitalclock

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  2. 这是基于FPGA开发板BASYS2的一个智能数字时钟,可以分3种模式:分钟,秒,百分之一秒。通过button切换模式并显示在数码管上-This is based on the FPGA development board BASYS2 a intelligent digital clock, can divide three patterns: the minutes and seconds, of a second.Through the button switch mode and in d
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.43mb
    • 提供者:黄志宇
  1. PS2_keyboard

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  2. 这是基于FPGA开发板NEXYS3的一个verilog程序,是一个ps2的键盘使用模块,包括检测和译码模块-This is based on the FPGA development board NEXYS3 a verilog program, is a ps2 keyboard module, including detection and decoding module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:604.29kb
    • 提供者:黄志宇
  1. LFSR

    0下载:
  2. 这是基于FPGA开发板NEXTS3的一个verilog程序,是一个线性反馈移位寄存器LFSR,可用来生成伪随机数-This is based on the FPGA development board NEXTS3 a verilog program, is a linear feedback shift register LFSR, can be used to generate pseudo random Numbers
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:838.93kb
    • 提供者:黄志宇
  1. stripe_mali

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  2. 这是基于FPGA开发板NEXYS3实现的verilog程序,是基于VGA原理的屏保程序,有横竖条纹还有移动的超级玛丽-This is based on the FPGA development board NEXYS3 verilog program, is based on the principle of VGA screensaver, stripe and mobile super Mary
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.62mb
    • 提供者:黄志宇
  1. vending_machine

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  2. 基于FPGA开发板NEXYS3的自动售货机,并利用VGA原理显示在LCD屏幕,采用键盘进行购买和支付-Based on the FPGA development board NEXYS3 vending machine, and use the principle of VGA display on the LCD screen, using the keyboard to purchase and payment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-11
    • 文件大小:17.13mb
    • 提供者:黄志宇
  1. 5.4.5_LMS

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  2. 自动滤波FPGA实现,使用的是VHDL语言!-Automatic filter FPGA implementation using VHDL language!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.41mb
    • 提供者:廖阳阳
  1. max41a

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  2. 用原理图方式实现4选1多路选择器,进行编译、综合、仿真测试等步骤-Schematic ways with 4-to-1 multiplexer, compile, synthesis, simulation testing and other steps
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:170.85kb
    • 提供者:zwq
  1. counter9

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  2. 运用VHDL输入方式设计一个0-9之间的减1计数器,完成程序的编译、综合、仿真测试,并给出仿真波形-Design using VHDL input between minus a 0-9 counter, complete compilation, synthesis, simulation, test procedures, and gives the simulation waveforms
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:182.92kb
    • 提供者:zwq
  1. banjian

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  2. 完成一个1位全减器的设计。以全减器为元件程序完成8位减法器设计。-Completed a one minus the whole design. Full reduction is to complete eight subtraction element program design.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:153.96kb
    • 提供者:zwq
  1. liushuideng

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  2. 基本的流水灯控制程序,简单的控制功能-Basic flow light control procedures, simple control functions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:162.11kb
    • 提供者:王志
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