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文件名称:H264

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-11-16
  • 文件大小:
    96.86kb
  • 已下载:
    3次
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介绍说明--下载内容来自于网络,使用问题请自行百度

h.264(verilog HDL)

这是基于流水线结构的H.264解码器源码-h.264 (verilog HDL) which is based on the pipeline structure of the H.264 decoder source code
(系统自动生成,下载前可以参看下载内容)

下载文件列表

H264/Beha_BitStream_ram.v
H264/BitStream_buffer.v
H264/BitStream_controller.v
H264/bitstream_gclk_gen.v
H264/BitStream_parser_FSM_gating.v
H264/bs_decoding.v
H264/cavlc_consumed_bits_decoding.v
H264/cavlc_decoder.v
H264/CodedBlockPattern_decoding.v
H264/dependent_variable_decoding.v
H264/end_of_blk_decoding.v
H264/exp_golomb_decoding.v
H264/ext_frame_RAM0_wrapper.v
H264/ext_frame_RAM1_wrapper.v
H264/ext_RAM_ctrl.v
H264/heading_one_detector.v
H264/hybrid_pipeline_ctrl.v
H264/Intra4x4_PredMode_decoding.v
H264/Intra_pred_PE.v
H264/Intra_pred_pipeline.v
H264/Intra_pred_reg_ctrl.v
H264/Intra_pred_top.v
H264/IQIT.v
H264/level_decoding.v
H264/nC_decoding.v
H264/nova.v
H264/nova_defines.v
H264/nova_tb.v
H264/NumCoeffTrailingOnes_decoding.v
H264/pc_decoding.v
H264/QP_decoding.v
H264/ram_async_1r_sync_1w.v
H264/ram_sync_1r_sync_1w.v
H264/reconstruction.v
H264/rec_DF_RAM_ctrl.v
H264/rec_gclk_gen.v
H264/run_decoding.v
H264/sum.v
H264/syntax_decoding.v
H264/timescale.v
H264/total_zeros_decoding.v
H264

相关说明

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