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  1. AD6.9常用元器件封装库

    0下载:
  2. pcb常用原件库,常用不常用,ad9和ad6使用的解压。啊就看大家都发(PCB common original libraryCB commonly used original library, commonly used not commonly used, Ad9 and AD6 use decompression. Oh, just look at everyone)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:
    • 文件大小:398.54kb
    • 提供者:反对
  1. 交通灯

    0下载:
  2. 简易交通灯基于单片机c51程序,运用visual c++ uvision,以及isis pro(this is a simple-traffic-light)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-24
    • 文件大小:17kb
    • 提供者:xiuping
  1. UART

    0下载:
  2. verilog IO模拟串口,用IO模拟uart进行串口通讯,无需硬件串口(Verilog io analog serial port, using io simulation UART serial communication, no hardware serial port)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-20
    • 文件大小:1.22mb
    • 提供者:yt14212
  1. cordic

    0下载:
  2. cordic算法的verilog实现,适用于学习。(The verilog implementation of CORDIC algorithm is suitable for learning.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-25
    • 文件大小:6.63mb
    • 提供者:yt14212
  1. 97957700spi

    0下载:
  2. 验证过的程序 ,平时自己测试用的,供大家参考使用。(Own serial test procedures, validation, and very complete. For your reference use)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-20
    • 文件大小:5kb
    • 提供者:wspudhy
  1. verilog_PLL

    0下载:
  2. 全数字锁相环的verilog源代码,包括鉴相器,K变摸可逆计数器,加减脉冲器和N分频器。已经仿真实现。(All digital phase-locked loop Verilog source code, including phase discriminator, K variable touch reversible counter, add and subtract pulse and N frequency divider. Have been implemented by simula
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-21
    • 文件大小:11kb
    • 提供者:小米1
  1. Zet-1.3.1

    0下载:
  2. 在单片FPGA上实现九十年代初期PC,可安装Windows3.1及其他DOS系统。SOC中包含以80286(cpu),中断控制器,显示控制器(VGA),声音控制器,PS2(鼠标,键盘)等。是了解计算机历史变迁及学习SOC设计的重要资料!(ZET aims to implement an early 90`s PC on FPGA.Which include a 80286(cpu),interrupt controller,display card(VGA),sound card,PS2 int
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-25
    • 文件大小:2.37mb
    • 提供者:VectorIII
  1. sp6

    0下载:
  2. 使用赛林思公司fpga开发的8为led流水灯程序。(Using, a company developed by FPGA, is a LED running water lamp program.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-24
    • 文件大小:109kb
    • 提供者:xshtx
  1. FIFO_ASY

    0下载:
  2. 异步FIFO,利用格雷码作异步FIFO指针减少亚稳态产生,利用同步寄存器放置亚稳态的级联传播。(Asynchronous FIFO, using gray code for asynchronous FIFO pointer to reduce metastable, cascade propagation using synchronous register placed metastable.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-18
    • 文件大小:2kb
    • 提供者:253765952
  1. 按键控制led

    0下载:
  2. 按键控制led灯亮灭顺序,从左到右跑或者从右往左跑(Press button to control the LED lights on and off)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-24
    • 文件大小:4.95mb
    • 提供者:baby321
  1. fir

    0下载:
  2.   电源滤波器是由电容、电感和电阻组成的滤波电路。滤波器可以对电源线中特定频率的频点或该频点以外的频率进行有效滤除,得到一个特定频率的电源信号,或消除一个特定频率后的电源信号。(Power filter is composed of capacitance and inductance and resistance of filter circuit.Specific frequency of the filter to the power cord or the point that the
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-24
    • 文件大小:7kb
    • 提供者:6Andd7
  1. 序列检测器

    0下载:
  2. 本例子为一个序列检测器的程序,序列为:11001001000010010100,检测的序列为10010(This example is a sequence detector procedure, the sequence is: 11001001000010010100, the detection sequence is 10010)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-20
    • 文件大小:18kb
    • 提供者:不唯花开
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