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  1. fifo_rs232

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  2. 从FIFO到到RS232的实现,用于接收和缓存数据-TripAdvisor RS232 FIFO implementation for receiving data and cache
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:893byte
    • 提供者:xiewh
  1. lcd12864

    0下载:
  2. LCD12864的驱动程序代码,亲测可用-LCD12864 driver code, pro-test available
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.97kb
    • 提供者:xiewh
  1. spi_ip

    0下载:
  2. SPI总线的IP核,可以实现半双工spi通信-SPI bus IP core, can achieve half-duplex communication spi
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.38kb
    • 提供者:xiewh
  1. rs232

    0下载:
  2. RS232总线协议ip,可以实现上位机通信-RS232 bus protocol ip, PC communication can be achieved
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:560byte
    • 提供者:xiewh
  1. Vhdl_testbench

    0下载:
  2. vhdl 的testbench编写教程,英文ppt以及源码工程-Write tutorials, as well as English ppt Source of engineering vhdl testbench
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-30
    • 文件大小:11.68mb
    • 提供者:吴欢欢
  1. GHDL

    0下载:
  2. quartus等文件业余爱好者测试仿真工具教程GHDL英文网站-quartus other documents amateur test simulation tools tutorial GHDL English website
  3. 所属分类:VHDL编程

    • 发布日期:2017-05-22
    • 文件大小:6.28mb
    • 提供者:吴欢欢
  1. uart

    0下载:
  2. 一种串行uart接口的实现,可支持对种通信速率,modlesim仿真-Realizing serial uart interface, which can support a variety of communication speed, modlesim simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-05
    • 文件大小:42.11kb
    • 提供者:许玉淇
  1. 7-BCD

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  2. 7段数码管控制接口程序和对初始频率为50MHZ的时钟的分频程序-7-segment control interface program and the initial frequency of 50MHZ clock divider program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:814byte
    • 提供者:李康康
  1. h_adder

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  2. 基于两个半加器和一个异或门组成的全加器(资料中波形图为半加器的时序仿真图)-Based on two half-adder and an exclusive-or gate full adder (profile picture shows a half adder waveform timing simulation diagram)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:60.5kb
    • 提供者:李康康
  1. IIR

    0下载:
  2. 基于nios ii嵌入式系统的IIR滤波器实现,自带ADC,DAC驱动代码-according nios ii
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-19
    • 文件大小:26.81mb
    • 提供者:jiangxin
  1. SATA_IP_FPGA

    0下载:
  2. SATA协议简要分析及其FPGA实现说明- SATA1.0 IP based on Fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:4.06mb
    • 提供者:wang
  1. SATA_Procotol_Summary

    0下载:
  2. SATA存储技术介绍文档,含协议及应用说明-SATA Technology
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:5.51mb
    • 提供者:wang
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