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  1. 基于vhdl的二进制转BCD码的设计

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  2. 基于vhdl的二进制转BCD码的设计,已经经过调试,可直接使用,Vhdl based on binary code to BCD design, has been testing can be used directly
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-27
    • 文件大小:801byte
    • 提供者:郭帅
  1. Altera DSP BUILDER 9.0 SP2 破解

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  2. Altera DSP BUILDER 9.0 SP2 破解,crack for dsp builder 9.0 SP2
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-25
    • 文件大小:5.43kb
    • 提供者:胡文静
  1. THS5651是一款高速DA转换器

    0下载:
  2. THS5651是一款高速DA转换器,最高转换频率可到达100MBPS,该程序利用VHDL语言对THS5651进行控制,THS5651 is a high-speed DA converter, the maximum conversion frequency can be arrived at 100MBPS, the use of VHDL language in the process control of the THS5651
  3. 所属分类:VHDL编程

    • 发布日期:2017-04-09
    • 文件大小:1.57mb
    • 提供者:陈宇
  1. 在de2FPGA开发板上实现视频的采集

    0下载:
  2. 在de2FPGA开发板上实现视频的采集,以及播放~~verilog代码 希望对大家有所帮助,CCD to capture video sent to SDRAM LCM to controller LCD LCD to display the picture~
  3. 所属分类:VHDL编程

    • 发布日期:2017-05-17
    • 文件大小:4.43mb
    • 提供者:Wu
  1. LPM 个人整理了一些quartus II 中常用的宏模块

    0下载:
  2. 个人整理了一些quartus II 中常用的宏模块,里面有他们的功能介绍,希望对大家有用。-Individuals compiled some commonly used macros quartus II module, which have their functional descr iption, want to be useful.
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-24
    • 文件大小:2.38kb
    • 提供者:杜维轩
  1. Spartan-3E--mac Spartan 3E开发板中实现以太网通讯

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  2. Spartan 3E开发板中实现以太网通讯-Spartan 3E development board Ethernet communications
  3. 所属分类:VHDL编程

    • 发布日期:2017-04-09
    • 文件大小:1.29mb
    • 提供者:柳园
  1. FPGAFSK该文档是基于FPGA的2FSK调制程序

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  2. 该文档是基于FPGA的2FSK调制程序,包含仿真结果-The document is based on FPGA-2FSK modulation process, including simulation results
  3. 所属分类:VHDL编程

    • 发布日期:2016-05-10
    • 文件大小:80kb
    • 提供者:鲁建
  1. VHDL-ROM4.基于ROM的正弦波发生器的设计

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  2. 基于ROM的正弦波发生器的设计:1.正弦发生器由波形数据存储模块(ROM),波形发生器控制模块及锁存模块组成 2.波形数据存储模块(ROM)定制数据宽度为8,地址宽度为6,可存储 64点正弦波形数据,用MATLAB求出波形数据。 3.将50MHz作为输入时钟。 ,ROM-based design of the sine wave generator: 1. Sinusoidal waveform generator by the data storage module (ROM), wav
  3. 所属分类:VHDL编程

    • 发布日期:2016-01-27
    • 文件大小:95.91kb
    • 提供者:宫逢源
  1. jdcbzh.使用VHDL语言实现串并转换模块的实现

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  2. 使用VHDL语言实现串并转换模块的实现,可在QUARTUS上实现,Use VHDL language string and conversion module, but in QUARTUS
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-23
    • 文件大小:1.32kb
    • 提供者:吴丹
  1. DataSort.rar

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  2. FPGA内,通过Verilog语言,实现冒泡法数据排序。仅供参考!,FPGA, through the Verilog language, implementation data bubble sort method. For reference purposes only!
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-28
    • 文件大小:4.92kb
    • 提供者:weishiji
  1. 用vhdl语言编写的2进制到10进制转换的程序

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  2. 本文为用vhdl语言编写的2进制到10进制转换的程序,为doc格式,使用前复制于maxplus等相应软件中使用。,This article was prepared by using VHDL language 2 hex to 10 hex conversion procedures for the doc format, the use of pre-replication in maxplus, such as the use of corresponding software.
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-22
    • 文件大小:2.8kb
    • 提供者:网天才
  1. masplus-works 用VHDL语言编写的八进制计数器

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  2. 用VHDL语言编写的八进制计数器,在MASPLUS环境下编译通过,可直接使用。-Octal counter using VHDL language, compiled by MASPLUS environment can be used directly.
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-21
    • 文件大小:37.52kb
    • 提供者:zeko
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