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  1. FPGA-implementation-of-DSP

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  2. 数字信号处理的FPGA实现,一本很不错的指导教程-FPGA implementation of digital signal processing, a very good tutorial
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-22
    • 文件大小:6.74mb
    • 提供者:bella
  1. Multi-function-digital-clock

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  2. 多功能数字钟,包含时钟,倒计时,秒表-Multi-function digital clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:2.14kb
    • 提供者:张三
  1. files1

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  2. This zip file contains vhdl code for MQencoder for jpeg2000 encoder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-05-22
    • 文件大小:4.54mb
    • 提供者:ramu
  1. good

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  2. 信号发生器,产生可调pwm信号,和可控的四路环路信号-singal merch
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:308.21kb
    • 提供者:王桢
  1. slides

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  2. Xilinx FPGA lab slide for beginner
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-31
    • 文件大小:12.65mb
    • 提供者:selin
  1. lcd_Ultimate

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  2. ILI9320 lcd的驱动程序及显示程序-ILI9320 driverS
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:255.6kb
    • 提供者:lavender
  1. DE2StandardCore

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  2. ALTERA DE2 开发板的最小NIOS系统-ALTERA DE2 BOARD MINI NIOS
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-29
    • 文件大小:11.45mb
    • 提供者:iFong
  1. EP3C

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  2. 利用Verilog编写的串口收发程序,波特率可调,经测试完全可以应用。-Use of serial transceiver in Verilog program, the baud rate is adjustable, can be applied by the test completely.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.35mb
    • 提供者:lobee
  1. DEMO_V

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  2. fpga点亮led灯的小程序 适合初学者-fpga led
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:95.2kb
    • 提供者:shijunjie
  1. EDA_PCI

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  2. 硬件描述语言实现PCI控制器的ipcore设计-ues Hardware descr iption language to design PCI control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:419.12kb
    • 提供者:罗惠玲
  1. nios-uart

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  2. 基于nios ii uart 驱动 带接收和发送缓冲区 很少的改动可以任意添加多个串口-Based on nios ii uart driving belt can transmit and receive buffer rarely changes can be more than add a serial port
  3. 所属分类:VHDL编程

    • 发布日期:2017-04-10
    • 文件大小:11.25kb
    • 提供者:hetao
  1. cpldrealizing-DUALportRAM-vhdl

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  2. 双端口RAM 实现对于RAM的同时读写操作-dualport ram with the VHDL to realize read or write the ram at the same time
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:763.19kb
    • 提供者:夏文瀚
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