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  1. 3dianti

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  2. 用Verilog实现模拟三层电梯控制,包括上行、下行、停止、开关门等效果。-Using Verilog to realize simulation of three layer elevator control, including the uplink, downlink, stop, switch door effect.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2.69mb
    • 提供者:色素
  1. PADTOKEY

    0下载:
  2. 将开发板上的按键转换成按键码,对键盘进行识别。-scan key pad
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:993byte
    • 提供者:黄锦文
  1. queue

    0下载:
  2. 完成FIFO功能:the first element added to a queue will occur in the first place in the queue, the second element added to the queue will be after the first one-a kind of First-In-First-Out (FIFO) data structure,the first element added to a queue will occ
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:545.6kb
    • 提供者:董俊翔
  1. FaceDetection

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  2. 基于adoost的fpga人脸检测程序,代码采用了verilog编写,用的是xilinx的virtex5芯片-face detection based on adboost. verilog is used,and virtex5 it isimplementated on virtex5.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-24
    • 文件大小:7.93mb
    • 提供者:张驠
  1. WORDFILE

    0下载:
  2. VHDL WILE FILE 可以在ue 通用文件-VHDL WILE FILE for ue programing
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:25.65kb
    • 提供者:liu
  1. pinlvji

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  2. 利用单片机实现数字频率计,4位数码管显示-Single-chip digital frequency meter, 4 digital tube display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:13.9kb
    • 提供者:田亮
  1. CODE

    0下载:
  2. code for floating point multiplication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:18.78kb
    • 提供者:nag
  1. DDS-VERILOG

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  2. DDS的信号发生器verilog代码 可直接用于编程 已经测试-Verilog code of the DDS signal generator which can be used directly in the programming has been tested
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:3.14kb
    • 提供者:佘琪
  1. aes

    0下载:
  2. AES is a code encryptioin function after RC5.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3.25kb
    • 提供者:dodo
  1. C51-Clock-display(LED)

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  2. 这是实验室教学中的程序,实现小时,分钟,秒的显示,通过数码管显示出来,请做参考-The program is tested in teaching. can display the hour,minute,second in LED by C51.thank you
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1.36kb
    • 提供者:张珂
  1. MAX_II_RevC_brd

    0下载:
  2. Altera CPLD开发板原理图和PCB -Altera CPLD
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.53mb
    • 提供者:19820521
  1. four_five

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  2. FPGA的VERILOG的小数分频,可以对任意小数分频,准确-FPGA is good for your study of your verilog langer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:228.27kb
    • 提供者:hushi
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