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  1. EDA

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  2. 里面包含了众多VHDL基础小程序,如38译码、4选1、4位加法、移位,七段显示译码等。-This contains a number of VHDL basis applet, such as 38 decoding, four selected 1,4 addition, the shift register, segment display decoder.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:559.85kb
    • 提供者:林崇坤
  1. histogram-equalization-verilog

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  2. 直方图均衡的Verilog实现 从Matlab读出图像为image.txt文件,经过Modelsim读入TXT文件进行直方图均衡处理,将输出结果再读出为image_he.txt文件,然后在Matlab观察直方图均衡增强效果。-The histogram equalization Verilog read from Matlab the image image.txt file after the Modelsim read into the TXT file, histogram equaliz
  3. 所属分类:VHDL编程

    • 发布日期:2014-01-16
    • 文件大小:2.01kb
    • 提供者:杨光
  1. led_flip

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  2. This is a counter and led that blink every second
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3.57mb
    • 提供者:hicham Bachour
  1. music.txt

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  2. 在设计手动播放和自动播放可以选择使用的电路中,程序在下载完成后,可以实现手动播放和自动播放的按键转换,通过switch按键,当按键处于‘1’状态时。则处于自动播放音乐(两只老虎),当按键‘0’时,处于手动播放音乐。自动播放和手动播放互不干扰,但是可以通过按键进行转换,最终实现实验目的。-In circuit design manual play and auto play can choose to use the program after the download is complete,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:904byte
    • 提供者:
  1. report

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  2. 利用VHDL语言实现基于pwm的D/A转换,要求,可以通过按键来分别选择占空比,从分别选择20,40,60,80。-Using VHDL language the pwm D/A conversion can be keys to select the duty cycle, from the Select 20, 40, 60, 80.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:75.33kb
    • 提供者:
  1. Mano-CPU_VHDL-Implementation

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  2. Mano s cpu for Man s instructions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:484.87kb
    • 提供者:hisham
  1. VHDL

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  2. 很多常用的小程序,可以用来组装,基于康芯公司开发板的程序-Many commonly used small procedures, can be used to assemble
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-09
    • 文件大小:15.16mb
    • 提供者:xiaoba
  1. lsd

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  2. VHDL流水灯测试通过,对初学者非常好的帮助。-The VHDL light water testing by the very good help for beginners.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:254.76kb
    • 提供者:hsj
  1. keyboard

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  2. 一个VHDL按键测试程序,对初学者非常有帮助。-VHDL key test program, very helpful for beginners.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:377.46kb
    • 提供者:hsj
  1. project

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  2. 函数信号发生器 能够发出不同类型的信号波形 比如方波 三角波-Function signal generator
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.68mb
    • 提供者:刘念
  1. Bit_synchronization

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  2. 这是一个位同步的FPGA完整代码,是用Verilog写的,其中包括分频、时钟、时钟提取等各模块以及顶层文件,做调制解调的朋友可以-This is a synchronous FPGA complete code is written in Verilog, including frequency, clock, clock extraction module and the top-level file, do the modulation and demodulation of a frien
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-01-16
    • 文件大小:3kb
    • 提供者:
  1. FULL-FPGA-SCH

    0下载:
  2. 包括Cyclone II EP2C20 原理图.CycloneII开发板原理图fpga.EP1C3T144 FPGA develop board manual.EP1C6Q240C6开发板原理图.EP2C8开发板原理图.EPM1270F256C5 MAX_II_board_schematics.SF-EP1V2+FPGA开发板原理图.XC3S400红色飓风开发板原理图.红色飓风II代开发板原理图2.-Including the Cyclone II EP2C20 schematic . Cycl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.92mb
    • 提供者:zgx
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