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  1. 2_key

    0下载：
  2. 利用两个相差一个时钟周期的寄存器进行&~运算，进行下降沿的检测。可用于按键消抖等。(Two regs are used to detect xiajaingyan with &~, and it can be used to switch debounce)

  3. 所属分类：VHDL/FPGA/Verilog

  1. ex8_232

    0下载：
  2. 这是一个用于自收自发的uart通讯代码，包括波特率设置模块、uart收发模块，上位机使用串口调试助手(Uart module is used to communite with PC in the way of spontaneous collection, including buad setting and transceiver. Upper computer is serial debugging assistant.)

  3. 所属分类：VHDL/FPGA/Verilog

  1. 3_8_decoder_20170407

    0下载：
  2. 一个简单的38译码器程序，内附真值表，在本实验例程程序中用于Cyclone 2。(A simple program for 38 decoder.)

  3. 所属分类：VHDL/FPGA/Verilog

  1. user_first_fpga_20170620

    0下载：
  2. 程序可实验开发板上LED循环点亮，且可通过按键控制流动速度，用到了PLL IP 和 计数器模块。(Program with LED flashing circuit uses PLL IP and counter. And extinction rate is controled by key.)

  3. 所属分类：VHDL/FPGA/Verilog

  1. FPGA_test_20170620_1

    0下载：
  2. 对50M的系统时钟进行分频处理，然后控制led的闪灭(Frequency divider controls led.)

  3. 所属分类：VHDL/FPGA/Verilog

  1. EDA课程设计

    0下载：
  2. 数据采集()

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2017-12-22
    • 文件大小：36700160
    • 提供者：玉立

  1. 基于FPGA的高速并转串程序

    2下载：
  2. 该程序用Verilog语言实现了12.5MHz八位并行转为150MHz串行数据.

  3. 所属分类：VHDL编程

  1. Vga_Module

    0下载：
  2. 使用FPGA控制VGA显示波形，显示汉字，水平垂直可调(FPGA controls the VGA display waveform)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2017-12-17
    • 文件大小：3072
    • 提供者：雷克萨

  1. HDMI_test

    0下载：
  2. 基于fpga板子和hdmi传输 测试代码文件(hdmi test code for FPGA)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2017-12-19
    • 文件大小：1024
    • 提供者：小志1993

  1. N25Q064A13E_VG12

    0下载：
  2. nand flash 仿真模型，官网下载，希望对大家有用(This software code and all associated documentation, comments or other information (collectively "Software") is provided "AS IS" without warranty of any kind.)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：
    • 文件大小：136192
    • 提供者：harveyzhou

  1. single_period

    0下载：
  2. 实现了单周期的数据通路，已通过基础的指令测试。(This program has finished single period .)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2017-12-12
    • 文件大小：132814
    • 提供者：Wanner_

  1. frequency

    0下载：
  2. 测频.d.d..d.d.d.d...d..d.d.d...dd..d.dd..dd..d.d.d.d..d.d(asdiflaewuifbufladjhbgailewyiowuriefj)

  3. 所属分类：VHDL/FPGA/Verilog

    • 发布日期：2017-12-23
    • 文件大小：172032
    • 提供者：6浪狗
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