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  1. serial-to-parallel

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  2. 学习串并转换的代码编写,认识编写风格和技巧,fpga官方网站的代码设计,可直接使用,通过了仿真-Learning string and converts the code written to recognize the writing style and skills, fpga official website of the code design, can be used directly, through simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-10
    • 文件大小:1.42kb
    • 提供者:阿汤哥
  1. uart

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  2. 一个简单的串口描述文件,可以实现基本的串口功能-A simple serial port descr iption file, you can achieve the basic function of serial
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:911byte
    • 提供者:阿汤哥
  1. UART16550(Verilog)

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  2. 通过各项仿真的模块代码,是一个标准的模块,可以直接使用-Through various simulation module code is a standard module, can be used directly
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:11.03kb
    • 提供者:阿汤哥
  1. 8b10encode

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  2. 8b10b编码器是设计高速数据发送的重要编码方式,其中有源代码还有具体设计文档-8b10b encoder design of high-speed data transmission encoding, including source code, there are specific design documents
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-23
    • 文件大小:763.35kb
    • 提供者:阿汤哥
  1. verilog-handouts

    0下载:
  2. 卡内基梅陇大学verilog讲义,包括综合,仿真,行为级建模-Carnegie Mellon University verilog handouts, including synthesis, simulation, behavioral modeling
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-21
    • 文件大小:229.44kb
    • 提供者:雷亮
  1. Lab_COUNTER

    0下载:
  2. Lab experiment : 50 MHz clk 4 bit counter (CLR + parallel load + pause ) on spartan3e
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-21
    • 文件大小:1.6kb
    • 提供者:fox
  1. Lab_LCD

    0下载:
  2. Building a character LCD interface on Spartan-3E FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-02
    • 文件大小:2.31kb
    • 提供者:fox
  1. Lab-PS2

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  2. implementing PS2 interface on Spartan-3E FPGA Kit (including the ucf file + PS2 module + main moudel as top level )
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-05
    • 文件大小:2.33kb
    • 提供者:fox
  1. adding-ad1981-ac97-coced-as-OBP-in-ML505-kit

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  2. inlcluded : AD1985 interface IP + C software for standalone microblaze using this interface to communicate with AD1985 codec
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-04
    • 文件大小:51.11kb
    • 提供者:fox
  1. cordic_atan

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  2. 实现cordic vector模式 3级流水线 24级迭代-24 iterations of the three pipeline cordic vector mode
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-06
    • 文件大小:2.83kb
    • 提供者:呵呵呵
  1. Bus_REG_Clk_Crosser

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  2. Clock crosser of register bus
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-08
    • 文件大小:1.06kb
    • 提供者:zomepolle
  1. lcd1602

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  2. 利用FPGA 点亮lcd1602,显示字符。利用FPGA 点亮lcd1602,显示字符-lcd1602 display lcd1602 display lcd1602 display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-07
    • 文件大小:1.29kb
    • 提供者:黎胜
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