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  1. CRC

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  2. CRC 8bit for bus monitor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:820byte
    • 提供者:郭涛
  1. CRC.vhd

    0下载:
  2. CRC 8bit for bus monitor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:821byte
    • 提供者:郭涛
  1. zuoye2

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  2. 主要编写了一组二进制数据通过根升余弦滤波器后的波形,但并没有使用ISE内部的FIR滤波器内核,该程序相当于编写了一个根升余弦滤波器。-Mainly prepared a set of binary data through the root raised cosine filter waveform after, but did not use the ISE internal FIR filter kernel, the program is equivalent to the prepara
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3.56mb
    • 提供者:林源
  1. sinwave

    0下载:
  2. 使用verilog hdl语言编程正弦波信号,能仿真出结果-Can use verilog HDL language programming sine wave signal, the simulation results
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:4.09mb
    • 提供者:hxj
  1. i2c_core

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  2. i2c ip core support slave and master mode
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.19mb
    • 提供者:bell
  1. xinhaoyuan

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  2. DDS产生多种波形信号发生器,包括正弦波,三角波,方波,锯齿波。运行于Altera Cyclone FPGA平台。-DDS signal generator generates a variety of waveforms including sine, triangle wave, square wave, sawtooth wave. Running on Altera Cyclone FPGA platform.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:59.64kb
    • 提供者:qiao
  1. 2fsk_0516

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  2. 运行于Altera Cyclone FPGA平台,基于DDS原理的FSK信号发生器,可产生FSK信号-Running on Altera Cyclone FPGA platform, based on the principle of DDS FSK signal generator for FSK signal
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:320.82kb
    • 提供者:qiao
  1. MOTO3--bujin

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  2. 运行于Altera Cyclone FPGA平台,顶层为原理图方式,模块由VHDL编写的步进电机驱动程序。-Running on Altera Cyclone FPGA platform, the top of the schematic way, module consists of VHDL stepper motor driver.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.39mb
    • 提供者:qiao
  1. MOTO3--zhiliu

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  2. 运行于Altera Cyclone FPGA平台,顶层为原理图方式,模块由VHDL编写的直流电机驱动程序。-Running on Altera Cyclone FPGA platform, the top of the schematic way, the module VHDL prepared by the DC motor driver.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.3mb
    • 提供者:qiao
  1. cmi

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  2. 运行于Altera Cyclone FPGA平台,由VHDL编写的NRZ到CMI编码和CMI到NRZ解码程序。-Running on Altera Cyclone FPGA platform, VHDL prepared NRZ to CMI CMI to NRZ encoding and decoding procedures.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:485.16kb
    • 提供者:qiao
  1. Manchester

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  2. 运行于Altera Cyclone FPGA平台,由VHDL编写的NRZ到曼彻斯特编码和曼彻斯特编码到NRZ解码程序。-Running on Altera Cyclone FPGA platform, consisting in VHDL coding NRZ to Manchester and Manchester encoding to NRZ decoding process.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:322.81kb
    • 提供者:qiao
  1. FPGA-verlog-SRAM

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  2. FPGA verlog SRAM -FPGA verlog SRAM aaaaaaaaaaaaaaaaaaaaa
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.3kb
    • 提供者:wsk
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