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  1. superdigitalclock

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  2. 这是基于FPGA开发板BASYS2的一个智能数字时钟,可以分3种模式:分钟,秒,百分之一秒。通过button切换模式并显示在数码管上-This is based on the FPGA development board BASYS2 a intelligent digital clock, can divide three patterns: the minutes and seconds, of a second.Through the button switch mode and in d
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.43mb
    • 提供者:黄志宇
  1. NiosII_I2C_bus

    0下载:
  2. 采用altera公司EP3C系列芯片实现的基于Nios II的I2C总线设计,采用Verilog编码-Altera company EP3C using the Nios II series chip I2C bus-based design using Verilog coding
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-01
    • 文件大小:12.89mb
    • 提供者:leeyg
  1. NiosII_SPI_bus

    0下载:
  2. 采用altera公司EP3C系列芯片实现的基于Nios II的SPI总线设计,采用Verilog编码-Altera company EP3C using the Nios II series chip SPI bus-based design, using Verilog coding
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:2.82mb
    • 提供者:leeyg
  1. project

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  2. 含project_基于FPGA与加速度计的体感超级马里奥游戏开发,基于spartan 3A开发板制作的小游戏-Project_ based on FPGA and accelerometer with the body feeling super Mario game development, based on the 3A Spartan development board produced by the small game
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:22.61kb
    • 提供者:刘健
  1. shuzicunchushiboqi

    0下载:
  2. 当输入信号进入数字式存储示波器时,通过A/D转换器将输入端的信号转换成相应的数字并存入存储器,该过程在采样时基电路的控制下不断地循环进行,而这时仪器的触发电路不断监测输入信号,看控制电路是否出现触发状态,一旦触发条件满足,则采样过程中断,处理器通过对存储器内采样数据的处理和显示,即可在屏幕上重现信号电压与时间的关系,也就是信号电压波形。-When the input signal into the digital storage oscilloscope, via A/D converter i
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:738.25kb
    • 提供者:洪艺琴
  1. vga

    0下载:
  2. fpga开发板通过VGA接口控制液晶屏显示程序,可用于广告牌等-fpga development board via VGA interface control LCD display program that can be used billboards
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-11
    • 文件大小:17.13mb
    • 提供者:王小二
  1. led

    0下载:
  2. FPGA控制流水灯时间及频率程序,可用于熟悉FPGA基础程序编写-FPGA control water lights time and frequency that you can use familiar FPGA-based programming
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.37mb
    • 提供者:王小二
  1. emac_standard

    0下载:
  2. 基于Xilinx的V5芯片设计的网络MAC层接口程序,可以与计算机进行网络通信,可根据自己需要进行裁剪定制,已通过板卡的实际测试。-Chip design based on Xilinx s network V5 MAC layer interface, can communicate with the computer network, can be tailored to customize according to their needs, the board has passed the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1.36mb
    • 提供者:赵明臣
  1. Ex18_key3x4

    0下载:
  2. 键盘3*4扫描,Verilog 语言编写-key scan 3*4 ,verilog hdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-27
    • 文件大小:204.49kb
    • 提供者:yinxiupu
  1. Ex12_state_machine

    0下载:
  2. 状态转换机,verilog hdl语言编写-stata machine ,verilog hdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:148.47kb
    • 提供者:yinxiupu
  1. Ex22_trafficlight

    0下载:
  2. 交通指示灯模拟,verilog hdl 语言编写-trafic signals,verilog hdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:308.51kb
    • 提供者:yinxiupu
  1. Ex16_dynamic_seg

    0下载:
  2. led 段码驱动器,verilog hdl编写-led segment driver ,verilog hdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:129.18kb
    • 提供者:yinxiupu
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