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  1. fft

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  2. 用VHDL语言来实现256点FFT的算法-256 FFt the VHDL implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:205.72kb
    • 提供者:易蒙
  1. int_div1

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  2. vhdl编写的任意分频器,经过测试好用,准确-divider vhdl any written, tested easy to use, accurate
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.49kb
    • 提供者:yuhan
  1. clock-a-stopwatch

    0下载:
  2. 基于DE2-70平台,可实现功能: 1、在LCD上显示时间 2、在数码管上显示跑表-DE2-70-based platform, enabling functions: 1、display time on the LCD 2、display stopwatch the digital tube
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:2.19kb
    • 提供者:Robert
  1. bei

    0下载:
  2. 应用VHDL语言写的倍频器,通过对高频信号的分频得到较低频率信号的倍频-Applications written in VHDL multiplier, high-frequency signals through low frequency signal divided by the frequency
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:1.11kb
    • 提供者:胡佳
  1. TW6816

    0下载:
  2. TW6816 – 4-CH Audio/Video Decoders with 66MHz PCI interface. Preliminary Data Sheet.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.32mb
    • 提供者:shista
  1. RS-code

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  2. 我测试过的!Verilog HDL实现RS编码。-I' ve tested it! RS coding Verilog HDL implementation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:959.84kb
    • 提供者:kiekie
  1. FPGA

    0下载:
  2. 5 款fpga开发板原理图和关于fpga的一些介绍 希望对大家有用-5 fpga development board schematic and on the introduction of fpga hope useful for all of us
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:651.29kb
    • 提供者:李白
  1. UC1608-24064

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  2. UC1608 24064驱动 COG LCD驱动程序-UC1608 24064
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-01-26
    • 文件大小:2kb
    • 提供者:周生
  1. vhdlad

    0下载:
  2. 基于VHDL的高速串行AD转换器控制设计与实现-VHDL-based high-speed serial AD converter control design and implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:174.44kb
    • 提供者:李涛
  1. ug_ram

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  2. RAM design for FPGA in verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:283.14kb
    • 提供者:NguyenViet
  1. fsm

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  2. VHDL新手入门:有限状态机练习(三段式结构)-VHDL Getting Started: Finite state machine exercises (three-stage structure)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:936byte
    • 提供者:Domo
  1. SystemverilogSource

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  2. systemverilog程序,需要的朋友可以参看-SystemVerilog procedures need friends can see
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:485.77kb
    • 提供者:
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