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  1. DigitalClock

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  2. 数字时钟,设置了多个按键,能够完成计时,分计时位闪烁,调整功能。-Digital clock, set the number of keys, to complete a time, sub-bit flash time adjustment function.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.26kb
    • 提供者:李月天
  1. eda1

    0下载:
  2. 数字电子钟 ,包括调整时间, 正点报时,整点报时时还有led灯点亮-digital clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.44mb
    • 提供者:小李
  1. DE0_SDRAM

    0下载:
  2. DE0开发板SDRAM测试程序,10为拨码开关作为数据写入SDRAM中存储,在读出用7段数码管显示-ALTERA DE0 SDRAM
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-09-02
    • 文件大小:7.46mb
    • 提供者:柳春青
  1. hspice1

    0下载:
  2. 电路设计和仿真工具hspice的重要使用文档。无师自通-Circuit design and simulation tools hspice important use of documents. Without a teacher
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.35mb
    • 提供者:yuzhen
  1. hspice2

    0下载:
  2. 电路设计和仿真工具hspice的重要使用文档。无师自通-Circuit design and simulation tools hspice important use of documents. Without a teacher
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:548.78kb
    • 提供者:yuzhen
  1. eetop.cn_Hspice.ppt

    0下载:
  2. 电路设计和仿真工具hspice的重要使用文档。无师自通-Circuit design and simulation tools hspice important use of documents. Without a teacher
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1.21mb
    • 提供者:yuzhen
  1. FullAdder

    0下载:
  2. This a code programed in Verilog Language. It is Full Adder code designed using Half Adder-This is a code programed in Verilog Language. It is Full Adder code designed using Half Adder..
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:684byte
    • 提供者:Faisal
  1. vga

    0下载:
  2. 小学期内容 硬件描述语言verilog 控制VGA显示-Primary verilog hardware descr iption language of content control VGA display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:2.57kb
    • 提供者:伍辰
  1. adch

    0下载:
  2. 利用ADC0804对外部输入的模拟信号进行采用获取当前电压值,在数码管上显示-ADC0804 external input using analog signals used to obtain the current voltage value displayed on the digital control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.2kb
    • 提供者:韩旭
  1. VerilogHDLsource

    0下载:
  2. Verilog HDL 高级数字设计源码-Advanced Digital Design Verilog HDL source
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:912.48kb
    • 提供者:陆存希
  1. VGA_1024_768

    0下载:
  2. VGA入门实例,已通过验证,可放心下载,在VGA上显示彩条.-VGA entry instance, has been validated, can rest assured that download, the VGA display of color.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.04mb
    • 提供者:陆存希
  1. Spartan3E_development_board_test_routines

    0下载:
  2. Spartan 3E开发板的实验例程,官方例程,品质保证!-Spartan 3E development board test routines
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-21
    • 文件大小:32.78mb
    • 提供者:陆存希
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