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  1. UDP_receiver

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  2. this is udp receiver application for sending packets through the ethernet
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:11.64kb
    • 提供者:suren
  1. rtl

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  2. this the generation of 48 pulses implementation in hdl language-this is the generation of 48 pulses implementation in hdl language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:6.3kb
    • 提供者:suren
  1. verilogHDL

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  2. Verilog学习资料,内容详尽,是初学者的最好资料-Verilog learning materials, content, detailed information is the best for beginners
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-16
    • 文件大小:3.97mb
    • 提供者:赵常青
  1. i2c_specs

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  2. I2C is a two-wire, bi-directional serial bus that provides a simple and efficient method of data exchange between devices.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:187.17kb
    • 提供者:navid
  1. FFT

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  2. FPGA嵌入式 fft 用FPGA实现FFT算法-FPGA fft
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:1.74kb
    • 提供者:asd
  1. mancodec

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  2. 曼彻斯特编码器与译码器 FPGA嵌入式项目开发-mancodec fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:181.96kb
    • 提供者:asd
  1. ourdev_481398

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  2. FPGA的仿真实例,Verilog代码编写,过程详尽,代码易懂。-FPGA simulation examples, Verilog coding, the process in detail, code easy to understand.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:27.31kb
    • 提供者:赵常青
  1. ourdev_481478

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  2. FPGA的仿真实例,Verilog代码编写,过程详尽,代码易懂。第二个文档-FPGA simulation examples, Verilog coding, the process in detail, code easy to understand. The second document
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:34.64kb
    • 提供者:赵常青
  1. ourdev_481401

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  2. FPGA的仿真实例,Verilog代码编写,过程详尽,代码易懂。第三个文档-FPGA simulation examples, Verilog coding, the process in detail, code easy to understand. The third document
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:35.57kb
    • 提供者:赵常青
  1. DigitalDesignandModelingwithVHDLandSynthesis

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  2. Digital Design and Modeling with VHDL and Synthesis
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:44.34mb
    • 提供者:medamine
  1. IEEEStandardVHDL

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  2. IEEE Standard VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:995.99kb
    • 提供者:medamine
  1. songxiugai

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  2. 乐曲演奏电路,能演奏歌曲,同时在数码管上显示演奏的乐曲音符的数字。-Music concert circuit, can play songs at the same time in the digital tube displays the number of notes played music.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:399.8kb
    • 提供者:方周
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