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  1. pspro

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  2. 计算机所用的键盘就是ps接口键盘,本设计是基于FPGA的ps2键盘接口设计,所用的编程语言是VHDL语言,已经通过了仿真,可以很好的实现功能-ps2keyboard interface with VHDL codes and it has useful
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:646byte
    • 提供者:microeric
  1. matriled

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  2. led显示器应用相当广泛,数码管的应用也很广泛,本设计就led驱动,数码管驱动进行了设计,设计中采用VHDL语言,在FPGA上实现了功能方真,在开发板上实现功能。-led driver, led scan
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:593byte
    • 提供者:microeric
  1. digitalwatch

    0下载:
  2. Describe: This VHDL digital clock, the use of digital control and FPGA design to achieve a number of counter clock, show hours, minutes ,seconds and alarm. The procedure depends on the metric system and consider six decimal counter preparation. The e
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:90.27kb
    • 提供者:eric carmen
  1. baseonVHDL

    0下载:
  2. 基于VHDL语言的8051IP核的设计与验证研究 是一篇我从通过学校校内IP下载的论文,觉得挺好-VHDL-8051IP-based design and verification of nuclear research is an IP I downloaded from the school through the school paper, I feel quite good
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-19
    • 文件大小:5.01mb
    • 提供者:shintar
  1. VHDL_8X8ledaaa

    0下载:
  2. 一个led8*8的vhdl程序 多余平时有兴趣玩玩led的朋友有小小的帮助-1 led8* 8 of the vhdl procedure superfluous in peacetime are interested in play led to a little help from friends
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:17.19kb
    • 提供者:邓忠飞
  1. 1DCT_VHDL

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  2. VHDL Behavioral Model for 1D DCT operation Algorithm : Calculates the 1D DCT coefficients. DCT Points range from 8 to 32. There is double buffering at the input, to allow continuous usage of DCT engine.-VHDL Behavioral Model for 1D DCT operation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:10.53kb
    • 提供者:NULL
  1. ddr_verilog_xilinx

    0下载:
  2. xilinx公司原版的DDR时序控制源码.-xilinx' s original source code of the DDR timing control.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:665.46kb
    • 提供者:suyufeng
  1. led7drv

    0下载:
  2. 7段LED驱动器的VHDL语言程序设计源码-7 segment LED driver source VHDL Language Program Design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:582byte
    • 提供者:lalo
  1. ledclock

    0下载:
  2. LED电子时钟控制器的VHDL语言程序设计-LED electronic clock controller VHDL Language Program Design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:932byte
    • 提供者:lalo
  1. e2prwctrl

    0下载:
  2. EEPROM芯片读写控制器的VHDL语音程序设计-EEPROM chip to read and write controller VHDL Voice program design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:1.29kb
    • 提供者:lalo
  1. mina

    0下载:
  2. 四位密码锁,默认密码3456,三次错误输入后上锁。-4 locks, the default password 3456, entered incorrectly three times after the lock.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:236.41kb
    • 提供者:龙一
  1. shifter

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  2. 8位移位器,实现算术左、右移位,逻辑左右移位和循环左右移位。-8-bit shift device to achieve arithmetic left and right shift, logical shift left shift and cycle around.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:209.88kb
    • 提供者:龙一
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