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  1. BasedonFPGASteppingMotorController

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  2. 这是我收集的基于FPGA的步进马达控制器,仅供初学者参考。-Based on FPGA Stepping Motor Controller
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1.08kb
    • 提供者:刘先生
  1. dsp_builder

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  2. Dsp Builder是一种将Matlab算法描述的语言,转换为硬件设计语言的工具。在VLSI和ULSI技术环境下,对于快速开发具有很大的帮助-Dsp Builder is a Matlab algorithm will be described in the language into hardware design language tools. In the VLSI and ULSI technology, environment, for the rapid development o
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.82mb
    • 提供者:qing
  1. Digital_Filters

    0下载:
  2. FPGA implementation of digital filters
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-23
    • 文件大小:135.92kb
    • 提供者:saeed
  1. NIOS200972416252332

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  2. VHDL.CPLD,用于编写液晶显示屏的驱动程序,显示各种zifu-VHDL.CPLD, for the preparation of liquid crystal display driver, display a variety of zifu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:789.43kb
    • 提供者:ybx
  1. zlg_avalon_rtl8019

    0下载:
  2. 周立功公司rtl8091IP核,接avalon总线,可实现以太网通信,有详细的说明-ZLG' s rtl8091IP nuclear, then avalon bus, Ethernet communications can be realized, a detailed descr iption of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:14.38kb
    • 提供者:KKK
  1. fq_counter

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  2. 这是一个关于计数器应用的小程序,可能很多书上都有-Counter Applet
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.49mb
    • 提供者:徐琪
  1. camera_link

    0下载:
  2. 对camera_link接口传输过来的信号进行格式转换,将16bit并行转换成串行输出-Right camera_link interface transfer over the signal format conversion will be converted into serial 16bit parallel output
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.65mb
    • 提供者:徐琪
  1. rs422

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  2. 程序将通过rs422接口传进来的16bit数据转成串行输出的数据-Program will pass through the rs422 interface 16bit data transfer incoming data into a serial output
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.57mb
    • 提供者:徐琪
  1. QQ

    0下载:
  2. 这是一个FPGA和pc机之间发送和接收的小程序。-This is an FPGA and pc machines to send and receive between the applets.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:232.3kb
    • 提供者:徐琪
  1. ripple_carry_counter

    0下载:
  2. verilog 语言的简单的4为脉动进位计数器,附带仿真的激励块-verilog language into a simple 4-bit counter for the pulse, with the incentive simulation block
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:389.49kb
    • 提供者:qirui
  1. eda

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  2. eda实验中常用到的模块,语言为VHDL-eda commonly used in experiments to the module, language VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:88.02kb
    • 提供者:闫更辉
  1. FPGA

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  2. FPGA系列入门教程,适合初学者,很实用。-Getting Started with FPGA Series tutorials for beginners, very practical.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:9.1mb
    • 提供者:闫更辉
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