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  1. Src

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  2. H.264编码算法的VHDL实现,很强大,很难得。-H.264 coding algorithm of VHDL to achieve, it is powerful, it is difficult to get.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:51.19kb
    • 提供者: 王王
  1. specman

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  2. SPECMAN基本指导,供VERILOG验证工程师使用。-SPECMAN basic guide for verification engineers VERILOG.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:51.16kb
    • 提供者:宙斯黄
  1. h.264_vhdl

    0下载:
  2. 使用Base Profile级别的H.264编码IP核,代码注释相当详细,流程清晰-Base Profile level H.264 encoder IP core, code comments in considerable detail, the process is clear
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:51.16kb
    • 提供者:李立鸣
  1. use_FPGA_control_VGA

    0下载:
  2. 实现了用fpga控制vga的输出,资料简单,但是具有代表性。-To achieve control using fpga vga output, the data is simple, but representative.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:51.15kb
    • 提供者:li
  1. adding-ad1981-ac97-coced-as-OBP-in-ML505-kit

    0下载:
  2. inlcluded : AD1985 interface IP + C software for standalone microblaze using this interface to communicate with AD1985 codec
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-04
    • 文件大小:51.11kb
    • 提供者:fox
  1. FSK-VHDL

    0下载:
  2. FSK调制与解调VHDL程序及仿真,仿真通过-FSK modulation and demodulation process, and VHDL simulation, simulation by
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:51.1kb
    • 提供者:海玲
  1. 8051core-Verilog

    0下载:
  2. 8051core-Verilog FPGA的51单片机内核源代码!
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:51.09kb
    • 提供者:EYE
  1. Audio_Demo

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  2. 基于xilinx的音频视频嵌入式源代码,用于播放.mp3文件。-Xilinx-based audio and video embedded source code, used to play. Mp3 files.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:51.09kb
    • 提供者:王亚
  1. vhdl_8cpu

    0下载:
  2. VHDL实现简单的8位CPU doc文件上有源代码-VHDL simple eight CPU doc documents Active code
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:51.08kb
    • 提供者:紫蓝
  1. FSK

    0下载:
  2. FSK调制与解调VHDL程序及仿真FSK modulation and demodulation process, and VHDL simulation-FSK modulation and demodulation process, and VHDL simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:51.08kb
    • 提供者:一天
  1. yingwenzimuxianshi

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  2. 显示0到F的十六进制数码管显示,数码管动态显示-Show 0 to F hexadecimal digital pipe display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:51.06kb
    • 提供者:涛涛
  1. yuanlitu

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  2. 这是康芯公司的GW48EDA_PKx实验系统的原理图。这试验箱功能很强大。希望给FPGA的初学者有所帮助。-This is the core company' s GW48EDA_PKx Kang experimental system schematic. This feature is very powerful chamber. FPGA beginner want to give help.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:51.05kb
    • 提供者:张阳
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