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  1. SMBus_xapp353

    1下载:
  2. SMBUS vhdl source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.04mb
    • 提供者:taiwan
  1. honglvdengkongzhi

    0下载:
  2. 这是描述红绿灯控制的程序,不是太复杂,是很简单的一个程序。-This is described in traffic light control procedures, not too complicated, it is a very simple procedure.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:748byte
    • 提供者:老马
  1. EasyUnderstandingAboutUSBForBeginner

    0下载:
  2. USB Explain for beginners
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:447.87kb
    • 提供者:auronstein
  1. FUNC_FLASH_CONFIGURE

    0下载:
  2. FPGA中用到的一款FLASH以及FLASH配置,-FPGA used in a FLASH, configuration,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.95mb
    • 提供者:david
  1. QPSvhdl

    0下载:
  2. QPSK的vhdl调制与解调,一篇论文,讲解很详细,并附带VHDL仿真设计程序-The vhdl QPSK modulation and demodulation, a paper to explain in great detail, and design program with VHDL simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.54mb
    • 提供者:张鑫
  1. 00000000000000

    0下载:
  2. 洗衣机代码!!!很好用啊,我灰常喜欢 很好用啊,我灰常喜欢-wash machine
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:210.6kb
    • 提供者:朱朱
  1. cpu16

    0下载:
  2. 16位cpu设计vhdl源码。主要实现risc机器模型-16-bit cpu design code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:177.71kb
    • 提供者:peterloo
  1. rightshift

    0下载:
  2. right shift register VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:625byte
    • 提供者:kirtikumar
  1. SEA

    0下载:
  2. Scalable Encryption Algorithm
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:100.15kb
    • 提供者:Tri
  1. VHDL

    0下载:
  2. it s aVHDL descr iption
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.34mb
    • 提供者:mero0o
  1. 100vhdl

    0下载:
  2. VHDL一百例,对初学者很有帮助!是学习VHDL不可多得的好资源!-VHDL one hundred cases, helpful for beginners! Is a rare good resources to learn VHDL!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:228.06kb
    • 提供者:喻祖华
  1. MUX16

    1下载:
  2. 基于VerilogHDL的简易的16位以为累加乘法器,包括乘法器模块和测试模块,已经通过仿真测试。-Based on the simple VerilogHDL that the cumulative 16-bit multiplier, including the multiplier module and test module has been tested by simulation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:904byte
    • 提供者:lacrimosa
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