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  1. utmi

    1下载:
  2. 介绍USB PHY接口中的UTMI接口, 对使用Verilog进行USB接口编程具有帮助。(This paper introduces UTMI interface in USB PHY interface. It is helpful for programming USB interface with Verilog.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-06-17
    • 文件大小:347kb
    • 提供者:李秦飞
  1. FT232H EEPROM Modify

    1下载:
  2. FT232H编程代码,可用于制作JTAG调试器(FT232H EEPROM Modify)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-06-09
    • 文件大小:621kb
    • 提供者:Metro
  1. 8b10b-master

    1下载:
  2. 8B/10Bencode and decoder
  3. 所属分类:VHDL编程

    • 发布日期:2021-03-23
    • 文件大小:6kb
    • 提供者:fangpei
  1. sdram控制

    1下载:
  2. sdram控制,verilog代码,实现sdram控制底层操作接口
  3. 所属分类:VHDL编程

  1. scan_led

    1下载:
  2. 用于8管脚的LED灯数码管显示,显示16进制数字。。。(LED verilog 8 legs display Verilog)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-07-04
    • 文件大小:121kb
    • 提供者:zkylsf
  1. W25Q80NE verilog Model

    1下载:
  2. SPI FLASH官方仿真模型方便modelsim testbench调试仿真(Official simulation model facilitates debugging and simulation)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-10-21
    • 文件大小:1.6mb
    • 提供者:chengruiqi
  1. test1

    1下载:
  2. 该程序实现的是一个比较器,输入两个数字,进行比较,将结果输出(The program implements a comparator that inputs two numbers, compares them, and outputs the results.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2019-07-04
    • 文件大小:33kb
    • 提供者:hello_tr
  1. 以太网MDIO接口

    1下载:
  2. 以太网的mac层与phy芯片之间的mdio接口通信,现已在lattice环境验证通过。
  3. 所属分类:VHDL编程

  1. phone_charge

    1下载:
  2. 投币式手机充电仪(另一个版本) 分为时间显示和金额显示两部分 根据投入的金额显示两倍时间,可随时清零,确定后倒计时,结束后自动返回初始状态(Coin-operated mobile phone charger(Another version) It is divided into two parts: time display and amount display. According to the amount of input, it shows twice the time. It can
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-05-24
    • 文件大小:1.78mb
    • 提供者:ctrlwdza
  1. 自动售货机

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  2. 使用1200PLC仿真实现自动售货机的运行过程(Using 1200 PLC to simulate the running process of vending machine)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2021-04-24
    • 文件大小:722kb
    • 提供者:singker
  1. pps_ketiao_rb2

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  2. FPGA程序,使用Verilog语言生成1个脉冲可调的PPS脉冲信号。(FPGA program generates 1 PPS pulse signal, using Verilog language.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-05-17
    • 文件大小:7.41mb
    • 提供者:张媛
  1. BPSK

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  2. 先用Matlab理论仿真,得出滤波器系数。再用Verilog语言在ISE环境下编写程序,通过Modelsim和ChipScope进行波形仿真和引号抓取,从而提高调试的效率。通过手机发送指令来控制上下变频器的参数。(Firstly, the filter coefficients are obtained by simulation with the theory of matlab. Then the program is written in Verilog language under IS
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-02-25
    • 文件大小:6.43mb
    • 提供者:财哥在此
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