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  1. FPGATimeQuestAnasiseREV7.0

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  2. FPGA那些事儿 TimeQuest静态时序分析REV7.0,需要的人员可以下载参考-FPGA those things TimeQuest static timing analysis REV7.0, needed can download the reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:8.31mb
    • 提供者:
  1. Chapter_4

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  2. E4_4_FilterCompare,FPGA实现的滤波器书的配套程序-E4_4_FilterCompare, FPGA realize filter book supporting program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-19
    • 文件大小:27.92mb
    • 提供者:
  1. Chapter_6

    0下载:
  2. FilterCompare,FPGA实现的滤波器书的配套程序-FilterCompare, FPGA realize filter book supporting program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:8.35mb
    • 提供者:
  1. Chapter_3

    0下载:
  2. FilterCompare,FPGA实现的滤波器书的配套程序-Filter Compare, FPGA realize filter book supporting program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:5.81mb
    • 提供者:
  1. Chapter_9

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  2. E9_1_DPSKSignalProduc,FPGA实现的滤波器书的配套程序-E9_1_DPSKSignalProduc, FPGA realize filter book supporting program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-18
    • 文件大小:4.87mb
    • 提供者:
  1. rbus2dma

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  2. rbus转dma,2个标准之间的bridge-rbus change to dmamodule
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.71kb
    • 提供者:johnny
  1. IRDA

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  2. 该代码利用veilong语言,能实现通过红外遥控让数码管显示相关数据-The code using veilong language, can be achieved through infrared remote control to allow the digital display of the relevant data
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.33mb
    • 提供者:相猛 唐
  1. car_data6_1_1

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  2. 用VHDL控制小车,具体包括对小车的方向、速度的控制。-With VHDL control of the car, including the direction of the car, the speed control.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-18
    • 文件大小:4.65mb
    • 提供者:litaiyun
  1. test_nios2

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  2. nios2的简单测试源码,关于nios2的简单最小系统的搭建,以及在Elipse下的下载调试-nios2 simple test source code, build on the simple minimum system nios2, debugging and downloading at the Elipse
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-11
    • 文件大小:16.72mb
    • 提供者:hehaibo
  1. test_cdce

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  2. 基于多核DSPTMS320C6678的时钟芯片CDCE62005的配置程序-Based on multi-core DSP TMS320C6678 clock chip CDCE62005 configuration program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-25
    • 文件大小:7.69mb
    • 提供者:hehaibo
  1. ook

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  2. FPGA自己编的BPSK,实现OOK 有电路搭建,容易理解-FPGA Own BPSK, OOK realize the circuit to build, easy to understand
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-24
    • 文件大小:6.94mb
    • 提供者:zanesachem
  1. mp3

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  2. 基于FPGA的mp3播放器 ,使用Verilog 语言,简单实现音乐播放器功能-FPGA MP3 player
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.57mb
    • 提供者:李涛
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