资源列表
uart_loopback
- uart loopback and test bench .
DDS_hzh
- 基于FPGA实现的DDS信号发生器，能产生正弦波、方波、锯齿波三种波形。-FPGA-based realization of DDS signal generator can produce sine, square, ramp three waveforms.
DDDDDDDDDSSS
- FPGA实现DDS正弦波、方波、三角波发生器Verilog程序（已验证）Quartus工程文件-FPGA realization DDS sine, square, triangle wave generator Verilog program (verified) Quartus Project Files
tugedafinal
- 使用Verilog HDL语言写的关于实现对ADC、MDC控制的程序，个人使用Quartus 7.2,在上面进行过仿真，暂时还没有发现问题-Using Verilog HDL language written on the realization of the ADC, MDC control procedures, personal use Quartus 7.2, in the above simulation carried out have had no problems found
ML605_LED
- ML605_LED 用Verilog HDL编写的LED闪烁的程序，很简单-ML605 LCD Verilog HDL prepared with flashing LED program, very simple
clock1
- 数字钟FPGA,时，分，秒，8位数码管，-digital clock
Top_MIL_1553B
- This the project, which implements MIL_1553 protocol.-This is the project, which implements MIL_1553 protocol.
fpga
- 用FPGA实现的多功能数字钟时，可以定闹钟，校对时间。-When implemented in an FPGA multifunction digital clock, you can set the alarm, set the time.
vga_1
- DE2开发板VGA显示,将图片通过VGA输出显示-DE2 Development and Education Board VGA display
Code-speed-adjustment-circuit
- 基于同步的数字 复接系统, 即输入的数据码流速率相同。若各 支路 的数 据码 流速 率不 同, 则 不能 直接 进行 复接, 因为复接合成后的数字信 号流, 在 接收端是无法分接恢复成原来的信号的, 为此在复接 前要使各支路数码率同步, 我们可以在设计的同步数字复接系 统前方加一码速调整单元, 以调整各支路的速码率使其同步, 并在分接 后再经过码速调整恢复为原来的速率。 -Based on the synchronous digital multiplex system, namely th
kbd_uart
- 利用FPGA设计的基于UART接口的键盘控制电路，可以实现键盘控制的部分功能-The use of UART interface keyboard control circuit design based on FPGA, can realize some functions of keyboard control
PCIe_13.1
- 基于FPGA的pcie13.0的接口控制模块的下载执行程序，可以直接实现pcie13.0接口的控制-FPGA pcie13.0 interface control module download executable program based on direct control can achieve pcie13.0 interface