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  1. chenxu

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  2. 序列检测其设计,检测11100110。并通过七段显示译码器显示。- Sequence Detection its design, testing 11100110.And through the seven-segment display decoder display.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:884byte
    • 提供者:谢英才
  1. DDSIP

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  2. 该程序实现了正弦函数与余弦函数数据的产生,可作为其他模块的输入信号(可以直接调用)-The program implements a sinusoidal function and cosine function data can be used as an input signal to other modules (direct call)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.14mb
    • 提供者:于子轩
  1. 4

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  2. 数控分频器设计。包括偶数分频,和奇数分频。- NC divider design. It includes an even divide, and odd division.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:314.26kb
    • 提供者:谢英才
  1. kairukaichu

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  2. 电力系统保护装置中使用的开入开出程序,只需要修改地址便可以跟DSP等配合使用。-The use of open power system protection device in a program, only need to modify the address can be used with DSP together.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-27
    • 文件大小:152.43kb
    • 提供者:wangfei
  1. lishi

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  2. 指示灯闪烁,数码管进行千计数,可供初学者学习-Flashing lights, digital tube counting 1000, for beginners to learn
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:673.12kb
    • 提供者:陈元
  1. XC95288-optical-cable-host

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  2. 本程序是基于Xilinx的CPLD95288芯片开发的光线通讯,AD7656AD采集功能的主机程序。-This procedure is a host-based communications program light of CPLD95288 Xilinx chip development, AD7656AD capture capability.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2.67kb
    • 提供者:杜含宇
  1. XC95288-optical-cable-slave

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  2. 本程序是基于Xilinx的CPLD95288芯片开发的光线通讯,AD7656AD采集功能的从机程序。-This procedure is based on Xilinx s CPLD95288 light communication chip development, AD7656AD acquisition the program.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2.29kb
    • 提供者:杜含宇
  1. VGA汉字显示

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  2. FPGA利用Verilog语言在Cyclon II器件上进行开发的VGA汉字显示.
  3. 所属分类:VHDL编程

    • 发布日期:2015-05-12
    • 文件大小:541.06kb
    • 提供者:dandelion4277
  1. pll_zsy.v

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  2. 全数字锁相环程序 此程序基于VHDL编写 可以完成相关功能-All digital phase-locked loop based on VHDL write program this program can complete the relevant function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:374.39kb
    • 提供者:赵政桐
  1. fir_s

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  2. FIR滤波器源代码 以及例化图和波形仿真图-FIR filter source code and instantiated figure and waveform simulation diagram
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:377.78kb
    • 提供者:孙旭丽
  1. cordic_new

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  2. cordic algorithm project.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:229.16kb
    • 提供者:cuong
  1. 123455

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  2. 32位累加器,包括32位加法器与寄存器,程序与仿真文件包含在内,在相应的环境下可直接运行-32-bit accumulator, including 32-bit adder and register, procedures and simulation files included, can be run directly under the corresponding environment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:194.39kb
    • 提供者:chaoshui
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