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  1. AD5300

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  2. DAC AD5300的verilog驱动,整个工程,亲测好用。-verilog code for AD5300 DAC.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-29
    • 文件大小:412.79kb
    • 提供者:科龙化
  1. lcd_12864

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  2. FPGA控制12864液晶显示、驱动,字符,汉字,用Verilog语言写的,经本人调试仿真过,绝对没问题-FPGA control 12864 LCD driver, characters, Chinese characters, written using Verilog language, I debug simulation absolutely no problem
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-17
    • 文件大小:505.03kb
    • 提供者:jinan
  1. lcd1602

    0下载:
  2. FPGA控制lcd1602液晶显示字符,经本人调试绝对没问题!-Character the FPGA control lcd1602 LCD, after I debug absolutely no problem!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-02
    • 文件大小:12.92mb
    • 提供者:jinan
  1. vgaa

    0下载:
  2. 用FPGA驱动VGA点亮显示器(VHDL)-use FPGA to drive VGA to light the screen
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-09
    • 文件大小:515.79kb
    • 提供者:张应松
  1. FPGA_UART

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  2. 毕业论文2010届06电子(的“基于FPGA的UART模块设计”-what is this
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:2.12mb
    • 提供者:sss
  1. I2C-Controller

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  2. I2C Controller for Serial EEPROMs, 包括源代码和说明文档,可以仿真-I2C Controller for Serial EEPROMs
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-19
    • 文件大小:384.85kb
    • 提供者:amy
  1. exp2

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  2. 按键控制的四位加、减法计数器(数码管显示)-Keys to control the four plus the subtraction counter (digital tube display)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-12
    • 文件大小:379.93kb
    • 提供者:liying
  1. pulser_16

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  2. 脉冲发生器,周期,延迟,脉宽均可调,调节部分使用niosII内核控制,已验证可用-Pulse generator cycle, delay, pulse width adjustable
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-08
    • 文件大小:2.49mb
    • 提供者:俞志伟
  1. PWM_LCD

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  2. 使用VHDL实现对LCD亮度的调节,原理是PWM脉宽调制,已验证-Use VHDL adjust LCD brightness, and the principles of the PWM pulse width modulation, Verified
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-04
    • 文件大小:4.3mb
    • 提供者:俞志伟
  1. verilog

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  2. 用于黑金开发板的例程,为verilog源代码,编译正确,可直接下载至开发板中。-Routines for black gold development board for verilog source code, compile properly, can be directly downloaded to the development board.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-10-30
    • 文件大小:6.14mb
    • 提供者:jiangqr
  1. Digital_clock11

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  2. 基于FPGA芯片设计多功能数字钟,具有任意时刻定时闹钟,有分频器,计数器,等等模块构成-Regular alarm clock based on the FPGA chip design multifunction digital clock, any time, divider, counter modules
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:489.81kb
    • 提供者:
  1. dianzhenxin1

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  2. 基于FPGA芯片设计点阵显示,具有汉字显示功能,由计数器,分频器,点阵显示模块等等组成-Based FPGA chip design dot matrix display with Chinese character display function, counter, divider, dot matrix display module, etc.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-03
    • 文件大小:386.57kb
    • 提供者:
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