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  1. IFFT

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  2. 使用ISE开发环境实现802.11a物理层OFDM系统中逆fft模块-ISE development environment inverse fft module 802.11a physical layer OFDM system
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:8.72mb
    • 提供者:余冰雁
  1. uart_tx

    0下载:
  2. 在SP605开发板上实现了串口的发送程序,并且通过验证。可以通过串口调试助手进行测试!-SP605 development board serial transmission program, and validation. Tested by serial debugging assistant!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:247.93kb
    • 提供者:曹荣丽
  1. clock

    0下载:
  2. 这是一个用eda设计的时钟实验程序,给大家参考-This is a eda design clock experiments, for your reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-29
    • 文件大小:205.76kb
    • 提供者:ld
  1. 3

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  2. 这是一个3为计数器的实验程序图,给大家参考一下-This is a 3 counter diagram of the experimental procedures, for your reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:183.7kb
    • 提供者:ld
  1. altera

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  2. 这是一个加法器的实验程序图,有不足之处请指正-This is an adder diagram of the experimental program, please correct the inadequacies
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-06
    • 文件大小:72.19kb
    • 提供者:ld
  1. Snack

    0下载:
  2. 用Verilog HDL实现贪吃蛇游戏。Ps2键盘输入,在电脑显示屏输出。-Snake game using Verilog HDL. The Ps2 keyboard input on the computer screen output.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-01
    • 文件大小:3.97mb
    • 提供者:Frank Chen
  1. pingpang

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  2. 用Verilog HDL实现乒乓球游戏,用PS2键盘输入,电脑显示器输出。-Table tennis game with Verilog HDL, PS2 keyboard input, the computer monitor output.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-18
    • 文件大小:397.43kb
    • 提供者:Frank Chen
  1. No.2DDS

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  2. 用Verilog HDL实现DDS信号发生器。-DDS signal generator using Verilog HDL.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:4.79mb
    • 提供者:Frank Chen
  1. No.3bujingdianji

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  2. 用Verilog HDL实现步进电机的控制。能智能控制转速。-Stepper motor control using Verilog HDL. Can the intelligent control speed.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-09
    • 文件大小:1.13mb
    • 提供者:Frank Chen
  1. ADCcaiyang

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  2. 用Verilog HDL实现ADC采样。-Stepper motor control using Verilog HDL. Can the intelligent control speed.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-29
    • 文件大小:2.13mb
    • 提供者:Frank Chen
  1. r

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  2. 统计8位矢量中‘1’的个数(分别用变量和信号两种方法实现)-Statistics of 8 bits of the number of 1 in the vector
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-01
    • 文件大小:11.13kb
    • 提供者:邓萍
  1. EDA

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  2. EDA课件中的状态机的学习资料,是PDF格式-The EDA in state machine learning materials, PDF format
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:280.92kb
    • 提供者:邓萍
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