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  1. SDRAM

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  2. FPGA上实现SDRAM初始化及控制源程序-Implemented on FPGA SDRAM initialization and control source
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-18
    • 文件大小:4.8mb
    • 提供者:李丽
  1. TFT_FullDisp

    0下载:
  2. FPGA 1.8寸 128×160TFT显示驱动程序-FPGA 1.8 inch display drivers 128160TFT
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-24
    • 文件大小:7.54mb
    • 提供者:李丽
  1. VGA

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  2. FPGA简单VGA彩条显示程序驱动程序640*480-FPGA simple VGA color display Driver 640* 480
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-24
    • 文件大小:3.76mb
    • 提供者:李丽
  1. DDS

    0下载:
  2. 基于FPGA的DDS详细设计方案(附带详细设计方案及代码)-DDS-based FPGA detailed design (with the detailed design and code)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:666.55kb
    • 提供者:李丽
  1. DIFF

    0下载:
  2. 基于FPGA的DIFF详细设计方案(附带详细设计方案及代码)-FPGA-based DIFF detailed design (with the detailed design and code)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:333.11kb
    • 提供者:李丽
  1. 7_lan

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  2. 黑金开发板ENC28J60的Nios驱动-Black gold ENC28J60 development board driver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:6.72kb
    • 提供者:龙韩
  1. FPGA_multiplier

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  2. 本源码是用verilog语言编写的FPGA乘法器,可以输入两个8位数据,出输16位结果。-The source code is written in verilog FPGA multiplier, you can enter two 8-bit data, the output 16 results.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:706byte
    • 提供者:黄华
  1. FPGA_SPI

    0下载:
  2. 本源码是用verilog语言编写的FPGA的SPI主机代码,可以用做SPI开发参考。-The source code is written in verilog FPGA SPI master code, can be used to develop a reference SPI.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:2.79kb
    • 提供者:黄华
  1. FPGA_Divider

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  2. 本源码是用verilog语言编写的FPGA的除法器和74LS138及D触发器模块。-The source code is written in verilog FPGA divider and 74LS138 and D flip-flop modules.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1002byte
    • 提供者:黄华
  1. FPGA_8bitLED

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  2. 本源码是用verilog编写的FPGA程序,其中包括了7段数码管显示模块和8位转换器。-The source code is written in verilog FPGA program, including 7-segment LED display module and 8-bit converters
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.08kb
    • 提供者:黄华
  1. paobiao

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  2. 本源码是用verilog编写的FPGA程序,其中包括了数字跑表模块和RS触发器模块。-The source code is written in verilog FPGA programs, including digital stopwatch module and the RS flip-flop modules.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:980byte
    • 提供者:黄华
  1. ASIC

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  2. 西安交大asic课件,对于数字集成电路的学习有帮助,经典-Xi' an Jiaotong University asic courseware for learning to help digital integrated circuits, classic
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-30
    • 文件大小:11.96mb
    • 提供者:李政政
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