资源列表
rad10
- 利用basys2实现十进制加减可逆计数器，拨码开关键SW1为自动可逆加减功能键，当SW1为HIGH时，计数器实现自动可逆模十加减计数功能，即4个七段数码管上几乎同步显示0—1—2—3—4—…9—8—7—…0—1…的模十自动可逆加减计数结果；当SW1为LOW时，计数器按拨码开关键SW0的选择分别执行加减计数功能。即当SW0为HIGH时，计数器实现模十加计数功能，即4个七段数码管上几乎同步显示0—1—2—3—4—…9——0—1…的模十加计数结果；当SW0为LOW时，计数器实现模十减计数功能，即4个七
greedy_snake
- 基于Basys2开发板实现VGA输出，PS/2键盘接入的贪吃蛇游戏，键盘上下左右控制方向，小键盘+键控制速度，小键盘回车开始游戏，空格暂停游戏。-Basys2 based development board to achieve VGA output, PS/2 keyboard access Snake game, up and down the keyboard to control the direction, speed control keypad+ key keypad Enter
verilog
- verilog 常用模块，包含设计模块和测试模块，如有ram, lifo等-verilog useful blocks
Turbo_Encoder_Decoder
- The turbo enocoder and turbo decoder is design in VHDL code.
brick_vdhl_vga
- 采用VHDL语言编写的打砖块游戏，由VGA等多个模块组成，编程软件是QuartusII，主控芯片是CycloneII。-Using VHDL language Arkanoid game the VGA and other modules, the programming software is QuartusII, the main chip is CycloneII.
Source-code-(all)
- direct sequence to generate sine code for altera
FIR
- 基于VHDL语言编写的FIR数字滤波器，要的速度-Finite Impulse Response
FPGA-high-precision-frequency-meter
- 基于FPGA的高精度频率计设计实验 展示数字存储示波器基本工作原理。 展示硬件测频和测周的基本原理。 在现有综合实践平台上开发DSO硬件频率计模块的方案及流程。 结合数据采集、存储和触发模块的FPGA代码。 FPGA代码完善DSO的频率计模块，实现高精度测频和测周功能。-FPGA-based high-precision frequency meter design experiments Demonstrate the bas
data_select4
- 四 路 数 据 选 择 器，从 四 路 数 据 选 择 一 路。-Quad data selector, all the way the four data.
coder_8_3
- 8 - 3 线 优 先 编 码 器 。高电平有效，高位到低位置位。高位优先级高于低位-8 3 line priority encoder. Active high, high to low bit. High priority than low
udpSender
- Module Ethernet UDPsender for spartan3E.
i2c
- I2C interface in VHDL